[发明专利]具有稳健数据读出的存储器以及读出数据的方法有效
| 申请号： | 200680031794.1 | 申请日： | 2006-08-29 |
| 公开（公告）号： | CN101253570A | 公开（公告）日： | 2008-08-27 |
| 发明（设计）人： | B·L·翰特尔;张莎彦 | 申请（专利权）人： | 飞思卡尔半导体公司 |
| 主分类号： | G11C7/02 | 分类号： | G11C7/02 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 秦晨 |
| 地址： | 美国得*** | 国省代码： | 美国;US |
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| 摘要： | 一种存储器(100)，包括第一(116)和第二(118)读出放大器、第一逻辑门(120)、第一三态驱动器(130)以及锁存器(180)。第一读出放大器(116)耦连到第一局部数据线并且具有用于将指示所选存储单元的状态的信号提供到第一局部数据线上的输出端子。第二读出放大器(118)耦连到第二局部数据线并且具有用于将指示所选存储单元的状态的信号提供到第二局部数据线上的输出端子。第一三态驱动器(130)具有耦连到第一逻辑门(120)的输出端子的数据输入端子，用于接收第一选择信号的控制输入端子，以及耦连到全局数据线的输出端子。锁存器(180)具有耦连到全局数据线(170)的输入/输出端子。 | ||
| 搜索关键词： | 具有 稳健 数据 读出 存储器 以及 方法 | ||
【主权项】：
1.一种存储器，包括：第一读出放大器，耦连到第一局部数据线，具有用于将指示所选存储单元的状态的信号提供到所述第一局部数据线上的输出端子；第二读出放大器，耦连到第二局部数据线，具有用于将指示所选存储单元的状态的信号提供到所述第二局部数据线上的输出端子；第一逻辑门，具有耦连到所述第一读出放大器的所述输出端子的第一输入端子、耦连到所述第二读出放大器的所述输出端子的第二输入端子、以及输出端子；第一三态驱动器，具有耦连到所述第一逻辑门的所述输出端子的数据输入端子、用于接收第一选择信号的控制输入端子、以及耦连到全局数据线的输出端子；以及锁存器，具有耦连到所述全局数据线的输入/输出端子。
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