[发明专利]异构多核处理器高速异步互连通信网络无效

专利信息
申请号: 200710035914.1 申请日: 2007-10-17
公开(公告)号: CN101132336A 公开(公告)日: 2008-02-27
发明(设计)人: 王志英;李勇;王蕾;戴葵;阮坚;赖明澈;龚锐;晋钢;李云照 申请(专利权)人: 中国人民解放军国防科学技术大学
主分类号: H04L12/40 分类号: H04L12/40;H04L12/46
代理公司: 国防科技大学专利服务中心 代理人: 郭敏
地址: 410073湖*** 国省代码: 湖南;43
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摘要: 发明公开了一种异构多核处理器高速异步互连通信网络,它由多个通信节点、多个通信栈、一个通信环与一个仲裁器连接而成,每个通信栈与一个通信节点通过数据线连接,所有的通信栈通过通信环两两连接,仲裁器与各通信栈通过数据线连接。通信栈由局部译码器、节点配置部件、通道控制器组成;仲裁器由从设备冲突检测部件、顺时针资源分配部件、逆时针资源分配部件、顺时针事务寄存器组、逆时针事务寄存器组、资源回收部件组成;通信环是将所有通信栈两两连接的环形连线,由交叉双向的多条通道、一条请求信号线、一条确认信号线组成。本发明支持所有通信节点之间点到点的并行传输,通信节点之间采用握手信号进行通信控制,可以节约功耗,提高通信速度。
搜索关键词: 多核 处理器 高速 异步 互连 通信 网络
【主权项】:
1.一种异构多核处理器高速异步互连通信网络,其特征在于它由多个通信节点、多个通信栈、一个通信环与一个仲裁器连接而成,每个通信栈与一个通信节点通过数据线连接,所有的通信栈通过通信环两两连接在一起,仲裁器与各个通信栈通过数据线连接;通信节点是向通信网络发出访问请求或被访问的设备,每个通信节点都有一个唯一的设备编号即设备ID;通信栈由局部译码器、节点配置部件以及通道控制器组成;仲裁器由从设备冲突检测部件、顺时针资源分配部件、逆时针资源分配部件、顺时针事务寄存器组、逆时针事务寄存器组以及资源回收部件组成;通信环是将所有通信栈两两连接的环形连线,由交叉双向的多条通道、一条请求信号线、一条确认信号线组成;通信节点向与之连接的通信栈发访问请求,通信栈对访问请求进行译码,确定是否向仲裁器发事务请求,即通信请求,以取得所请求设备即另一个通信节点的访问权;仲裁器则负责事务仲裁,判断发出请求的通信节点能否获得访问权,并控制通信栈将通信环切分成不同的传输路径使获得访问权的通信节点完成通信。
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