[发明专利]一种协处理器有效

专利信息
申请号: 200710118430.3 申请日: 2007-07-05
公开(公告)号: CN101082859A 公开(公告)日: 2007-12-05
发明(设计)人: 董明;梁维谦;李鹏;智强;刘润生 申请(专利权)人: 清华大学
主分类号: G06F7/52 分类号: G06F7/52;G10L15/14
代理公司: 北京三高永信知识产权代理有限责任公司 代理人: 何文彬
地址: 10008*** 国省代码: 北京;11
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摘要: 发明公开了一种协处理器,属于集成电路设计领域。所述协处理器包括:存储模块、地址产生模块、寄存器组模块、控制电路模块和计算模块。本发明提供的协处理器可以进行基于HMM语音识别算法的马氏距离计算和乘累加运算,能够提高嵌入式语音识别系统的性能,同时可完成通用DSP中的矢量乘累加运算,扩展了其通用性,具有提高性能,降低成本,降低功耗的优点。
搜索关键词: 一种 处理器
【主权项】:
1.一种协处理器,其特征在于,所述协处理器包括:存储模块、地址产生模块、寄存器组模块、控制电路模块和计算模块;所述存储模块通过内部地址总线与所述地址产生模块相连,通过外部地址总线、外部数据总线和外部控制总线与外部处理器相连,通过内部控制总线与所述控制电路模块相连,通过内部数据总线与所述计算模块相连,用于存储计算过程中的特征矢量、模型状态矢量和计算结果;所述地址产生模块通过内部数据总线与所述寄存器组模块相连,通过内部控制总线与所述控制电路模块相连,用于在所述控制电路的作用下产生所述存储模块中存储的特征矢量和计算结果的地址;所述寄存器组模块与所述存储模块统一编址,通过内部数据总线与所述计算模块相连,用于存储各个特征矢量和计算结果的起始地址;所述控制电路模块的输入端通过内部数据总线与所述寄存器组模块的输出端相连,用于通过读所述寄存器组模块中的各个寄存器的内容进行计数器初始化控制、矢量乘累加控制和矢量乘乘累加控制;所述计算模块与内部数据总线和内部控制总线相连,用于对所述存储模块中的特征矢量进行绝对值运算和乘乘加运算,并将计算的结果通过内部数据总线输出给所述存储模块。
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