[实用新型]高速可信网络处理器有效
| 申请号： | 200720113622.0 | 申请日： | 2007-08-23 |
| 公开（公告）号： | CN201091005Y | 公开（公告）日： | 2008-07-23 |
| 发明（设计）人： | 顾士平;华晓勤 | 申请（专利权）人： | 顾士平 |
| 主分类号： | G06F15/00 | 分类号： | G06F15/00 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 215000江苏省苏州*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型高速可信网络处理器，涉及一种由动态可重构集成电路组成的高速可信网络处理器，动态可重构集成电路连接动态可重构集成电路的配置电路、用户数据输入/输出电路、随机存储器、键盘、鼠标、显示器；动态可重构集成电路包括多个可重构单元，每个可重构单元由带配置队列的SRAM可重构电路和配置时钟构成；当对应的配置单元的配置时钟允许时对配置单元进行配置，即更新对应的指令；当配置时钟禁止时，不对配置单元配置数据进行更新，保留原有的配置，即保留原有的可重构指令。本实用新型可广泛应用嵌入式处理器、通信处理器、网络处理机尤其是网格计算的处理器，具有广泛的应用前景。 | ||
| 搜索关键词： | 高速 可信 网络 处理器 | ||
【主权项】：
1.一种高速可信网络处理器，包括：由动态可重构集成电路组成的高速可信网络处理器，动态可重构集成电路连接动态可重构集成电路的配置电路、用户数据输入/输出电路、随机存储器、键盘、鼠标、显示器；其特征包括是：动态可重构集成电路包括多个可重构单元，每个可重构单元由带配置队列的SRAM可重构电路和配置时钟构成；当对应的配置单元的配置时钟允许时对配置单元进行配置，即更新对应的指令；当配置时钟禁止时，不对配置单元配置数据进行更新，保留原有的配置，即保留原有的可重构指令。
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