[发明专利]伪周期逻辑信号生成器有效
| 申请号： | 200780030064.4 | 申请日： | 2007-07-27 |
| 公开（公告）号： | CN101501632A | 公开（公告）日： | 2009-08-05 |
| 发明（设计）人： | A·阿涅雷;F·德洛雷因;J·库约 | 申请（专利权）人： | 雷诺股份公司 |
| 主分类号： | G06F7/00 | 分类号： | G06F7/00;H03K5/00 |
| 代理公司： | 北京市中咨律师事务所 | 代理人： | 于 静;杨晓光 |
| 地址： | 法国布洛*** | 国省代码： | 法国;FR |
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| 摘要： | 一种平均周期为Tmean的伪周期逻辑信号的生成器，包括：周期为Tref的基准时钟(5)；收到脉冲时改变状态的逻辑存储装置(6)；用于在基本的时间间隔Tsec＝K×Tref结束时生成额定脉冲的第一装置(7)，其中K是整数；用于在修改的时间间隔T’sec＝(K±1)×Tref结束时生成偏置脉冲的第二装置(8)；选择装置(10、12)，其能够选择生成脉冲的装置，以便为了生成伪周期信号而定期地纳入偏置脉冲来校正平均周期。一种为生成等离子火花来进行射频点火而对谐振器的驱动的应用。 | ||
| 搜索关键词： | 周期 逻辑 信号 生成器 | ||
【主权项】：
1. 一种平均周期为Tmean的伪周期逻辑信号的生成器(2)，其特征在于，包括：-基准时钟(5)，其能够生成周期为Tref的基准信号(1)；-逻辑存储装置(6)，其作为输出(62)而提供所存储的逻辑状态并且可以被控制成当收到脉冲时改变状态；-第一生成装置(7)，其能够在基本的时间间隔Tsec＝K×Tref结束时从所述基准信号(1)中生成额定脉冲，其中K是整数；-第二生成装置(8)，其能够在修改的时间间隔T’sec＝(K±1)×Tref结束时从所述基准信号(1)中生成偏置脉冲；-选择装置(10、12)，其能够在所述第一生成装置(7)与所述第二生成装置(8)之间选出生成控制所述逻辑装置(6)的脉冲的装置，定期地纳入用于校正所述平均周期的偏置脉冲从而生成平均周期为的伪周期信号(2)，其中K是整数并且L是介于0和1之间的真实的校正因子。
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