[发明专利]具有速率匹配的高计算效率的卷积编码有效
| 申请号： | 200880019235.8 | 申请日： | 2008-06-06 |
| 公开（公告）号： | CN101836387A | 公开（公告）日： | 2010-09-15 |
| 发明（设计）人： | J-F·程 | 申请（专利权）人： | 艾利森电话股份有限公司 |
| 主分类号： | H04L1/00 | 分类号： | H04L1/00 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 刘春元;王丹昕 |
| 地址： | 瑞典斯*** | 国省代码： | 瑞典;SE |
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| 摘要： | 一种差错编码电路，包括：非系统性卷积编码器，用于对输入比特流进行编码以产生两组或更多组奇偶校验比特；交织器电路，用于对每组奇偶校验比特内的奇偶校验比特进行交织；以及速率匹配电路，用于输出选定数目的交织的按组排序的奇偶校验比特以获得期望码率。 | ||
| 搜索关键词： | 具有 速率 匹配 计算 效率 卷积 编码 | ||
【主权项】：
一种差错编码电路，包括：非系统性卷积编码器，用于对输入比特流进行编码以产生两组或更多组奇偶校验比特；交织器电路，用于对每组奇偶校验比特内的奇偶校验比特进行交织；以及速率匹配电路，用于输出选定数目的所述交织的按组排序的奇偶校验比特以获得期望码率。
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