[发明专利]半导体集成电路有效
| 申请号： | 200910129709.0 | 申请日： | 2009-03-24 |
| 公开（公告）号： | CN101546600A | 公开（公告）日： | 2009-09-30 |
| 发明（设计）人： | 井口智明;石川瑞恵;杉山英行;齐藤好昭 | 申请（专利权）人： | 株式会社东芝 |
| 主分类号： | G11C11/16 | 分类号： | G11C11/16;H01L27/22;H01L43/08 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 | 代理人： | 郭 放 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种半导体集成电路，其特征在于，具备：N沟道型自旋FET(SN1)，在其源端以及漏端间具有取高电阻状态和低电阻状态之一的磁隧道结或半导体-磁性体结，在栅端输入输入信号，在源端施加第一电源电位，漏端与输出端相连接；P沟道型FET(P1)，在其栅端输入时钟信号，在源端施加比上述第一电源电位高的第二电源电位，漏端与上述输出端相连接；后级电路(12)，其输入端与上述输出端相连接；以及控制电路(11)，在使上述P沟道型FET(P1)导通而开始了上述输出端的充电之后，使上述P沟道型FET(P1)截止从而结束上述充电，并将上述输入信号提供给上述N沟道型自旋FET(SN1)的栅端。 | ||
| 搜索关键词： | 半导体 集成电路 | ||
【主权项】：
1. 一种半导体集成电路，其特征在于，具备：N沟道型自旋FET(SN1)，在其源端以及漏端间具有取高电阻状态和低电阻状态之一的磁隧道结或半导体-磁性体结，在栅端输入输入信号，在源端施加第一电源电位，漏端与输出端相连接；P沟道型FET(P1)，在其栅端输入时钟信号，在源端施加比上述第一电源电位高的第二电源电位，漏端与上述输出端相连接；后级电路(12)，其输入端与上述输出端相连接；以及控制电路(11)，在使上述P沟道型FET(P1)导通而开始了上述输出端的充电之后，使上述P沟道型FET(P1)截止从而结束上述充电，并将上述输入信号提供给上述N沟道型自旋FET(SN1)的栅端。
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