[发明专利]使用简化网表来生成布图规划的方法和设备有效
申请号: | 200910207631.X | 申请日: | 2009-10-28 |
公开(公告)号: | CN101833590A | 公开(公告)日: | 2010-09-15 |
发明(设计)人: | K·B·里斯;D·L·皮尔特 | 申请(专利权)人: | 新思科技有限公司 |
主分类号: | G06F17/50 | 分类号: | G06F17/50 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华 |
地址: | 美国加利*** | 国省代码: | 美国;US |
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摘要: | 一个实施方式提供了包括为分层级电路设计生成布图规划的方法和设备的系统。更具体地,该系统可以接收针对分层级电路设计的非简化网表描述,并生成包括该网表的接口逻辑元件的简化网表。该系统随后可以通过使用简化网表作为输入来生成布图规划。注意,生成布图规划所需的计算资源和时间的量显著减小了,这是因为系统使用简化网表替代使用非简化网表来生成布图规划。 | ||
搜索关键词: | 使用 简化 网表来 生成 规划 方法 设备 | ||
【主权项】:
一种用于为分层级电路设计生成布图规划的方法,其中所述分层级电路设计利用一组块来表示,并且其中所述布图规划指定满足一组设计约束的用于该组块的布置,所述方法包括:接收针对所述分层级电路设计的非简化网表,其包括对于该组块中电路元件的描述;根据所述非简化网表生成简化网表,其中对于该组块中的块而言,所述简化网表仅包括对于在该块中与所述块的接口逻辑相关联的那些电路元件的描述;以及使用所述简化网表来为所述分层级电路设计生成满足该组设计约束的所述布图规划。
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