[发明专利]接口电路无效
| 申请号： | 200980139367.9 | 申请日： | 2009-09-04 |
| 公开（公告）号： | CN102171967A | 公开（公告）日： | 2011-08-31 |
| 发明（设计）人： | 小松义英;江渊刚志;有马幸生;岩田彻 | 申请（专利权）人： | 松下电器产业株式会社 |
| 主分类号： | H04L7/04 | 分类号： | H04L7/04;H04L25/02 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 汪惠民 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种接口电路。主机设备(1)的LSI(10)基于基准时钟(RFC1)，个别地生成发送用时钟(TC1)和接收用时钟(RC1)。并且，还生成辅助设备(2)用的基准时钟(RFC2)。基准时钟(RFC2)被转换为差动时钟后发送给辅助设备(2)。辅助设备(2)的LSI(20)基于由差动时钟转换后的基准时钟(RFC3)，个别地生成发送用时钟(TC2)和接收用时钟(RC2)。 | ||
| 搜索关键词： | 接口 电路 | ||
【主权项】：
一种接口电路，用于在主机设备和辅助设备之间双向执行数据传输，其特征在于，该接口电路具备：第一LSI，其被搭载于所述主机设备；和第二LSI，其被搭载于所述辅助设备，所述第一LSI具备：第一时钟生成电路，其基于第一基准时钟，个别地生成第一发送用时钟和第一接收用时钟，并且生成所述辅助设备用的第二基准时钟；差动驱动器，其将所述第二基准时钟转换为差动时钟，向所述辅助设备输出；第一发送电路块，其使用所述第一发送用时钟将并行数据转换为差动串行信号，向所述辅助设备输出；和第一接收电路块，其从所述辅助设备接收差动串行信号，在使用所述第一接收用时钟使定时一致之后转换为并行数据，所述第二LSI具备：差动接收器，其从所述主机设备接收差动时钟，并转换为第三基准时钟；第二时钟生成电路，其基于所述第三基准时钟，个别地生成第二发送用时钟和第二接收用时钟；第二发送电路块，其使用所述第二发送用时钟将并行数据转换为差动串行信号，向所述主机设备输出；和第二接收电路块，其从所述主机设备接收差动串行信号，在使用所述第二接收用时钟使定时一致之后转换为并行数据。
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