[发明专利]具有内核时钟同步的均步信号传输系统无效
| 申请号： | 200980151567.6 | 申请日： | 2009-07-09 |
| 公开（公告）号： | CN102257572A | 公开（公告）日： | 2011-11-23 |
| 发明（设计）人： | F·A·韦尔;R·E·帕尔默;J·W·鲍尔顿;A·M·福勒 | 申请（专利权）人： | 拉姆伯斯公司 |
| 主分类号： | G11C11/407 | 分类号： | G11C11/407;H03K19/0175 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 酆迅 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 在低功率信号传输系统中，集成电路设备包括开环时钟分发电路和发射电路，它们协同操作以支持未伴随源同步定时参考的信息承载符号的高速发射。开环时钟分布电路响应于外部供应的时钟信号生成发射时钟信号，并且发射电路响应于发射时钟信号的转变向外部信号线上输出符号序列。每个符号在符号时间内在发射电路的输出处有效，并且允许发射时钟信号与外部供应的时钟信号之间的相位偏移漂移至少该符号时间。 | ||
| 搜索关键词： | 具有 内核 时钟 同步 信号 传输 系统 | ||
【主权项】：
一种集成电路存储器设备，包括：时钟输入，用于从外部源接收第一时钟信号；信号传输电路，用于响应于所述第一时钟信号的转变从所述集成电路存储器设备输出数据信号，其中所述第一时钟信号包括针对以所述数据信号传达的数据的每个位的相应转变；时钟生成电路，用于响应于所述第一时钟信号的转变生成第二时钟信号，所述第二时钟信号在所述第一时钟信号的每N个周期循环一次，N为大于1的整数，所述时钟生成电路包括相位调节电路用于使所述第二时钟信号的相位能够相对于所述第一时钟信号的相位进行调节。
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