[发明专利]分栅型非易失性存储器及其制造方法有效
申请号: | 201010022703.6 | 申请日: | 2010-01-12 |
公开(公告)号: | CN101777519A | 公开(公告)日: | 2010-07-14 |
发明(设计)人: | 江红 | 申请(专利权)人: | 上海宏力半导体制造有限公司 |
主分类号: | H01L21/8247 | 分类号: | H01L21/8247;H01L27/115 |
代理公司: | 上海思微知识产权代理事务所(普通合伙) 31237 | 代理人: | 郑玮 |
地址: | 201203上海市*** | 国省代码: | 上海;31 |
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摘要: | 一种分栅型非易失性存储器的制作方法,包括:在半导体衬底上依次形成耦合介质层,第一传导层以及刻蚀阻挡层;在刻蚀阻挡层上形成开口,在开口内沉积隔离介质层以及第一耦合传导层;在开口的侧壁形成支撑介质层;刻蚀第一耦合传导层,隔离介质层,第一传导层以及耦合介质层至暴露除半导体衬底,形成两个分离的结构单元;形成源极;形成第一侧壁层;在两个分离的结构单元之间的间隙中填充第二耦合传导层;在第二耦合传导层以及支撑介质层的表面形成保护层;去除刻蚀阻挡层;以保护层为掩膜,去除其它位置的第一传导层以及耦合介质层,去除保护层;形成隧道介质层;在隧道介质层的外侧形成控制栅极;形成漏极。所述结构提高了存储器的编程能力。 | ||
搜索关键词: | 分栅型 非易失性存储器 及其 制造 方法 | ||
【主权项】:
一种分栅型非易失性存储器的制作方法,包括:提供半导体衬底,在所述的半导体衬底上依次形成耦合介质层,第一传导层以及刻蚀阻挡层;在所述的刻蚀阻挡层上形成开口,在所述的开口内沉积隔离介质层以及位于隔离介质层上的第一耦合传导层,隔离介质层和第一耦合传导层的厚度之和小于开口高度;在所述开口的侧壁形成支撑介质层;以所述刻蚀阻挡层和支撑介质层为掩膜,刻蚀第一耦合传导层,隔离介质层,第一传导层以及耦合介质层至暴露除半导体衬底,形成两个分离的包括支撑介质层、第一耦合传导层,隔离介质层,第一传导层和耦合介质层的结构单元;以所述刻蚀阻挡层和支撑介质层为掩膜,在半导体衬底内进行第一离子注入,形成源极;在两个分离的耦合介质层、第一传导层、隔离介质层以及部分第一耦合传导层的内侧壁形成第一侧壁层;在两个分离的结构单元之间的间隙中填充第二耦合传导层,第二耦合传导层与第一耦合传导层电接触;在所述的第二耦合传导层以及支撑介质层的表面形成保护层;去除刻蚀阻挡层;以所述保护层为掩膜,去除其它位置的第一传导层以及耦合介质层,至暴露出半导体衬底,刻蚀后保留的第一传导层作为半导体器件的浮栅,去除所述保护层;在两个分离的结构单元外侧壁以及结构单元外侧的半导体衬底上形成呈L型的隧道介质层;在所述隧道介质层的外侧形成控制栅极;在控制栅外侧的半导体衬底内进行离子注入,形成漏极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
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