[发明专利]超速时延测试系统及测试方法有效
| 申请号： | 201010033983.0 | 申请日： | 2010-01-07 |
| 公开（公告）号： | CN101764125A | 公开（公告）日： | 2010-06-30 |
| 发明（设计）人： | 裴颂伟;李华伟;李晓维 | 申请（专利权）人： | 中国科学院计算技术研究所 |
| 主分类号： | H01L23/544 | 分类号： | H01L23/544;H01L21/66 |
| 代理公司： | 北京律诚同业知识产权代理有限公司 11006 | 代理人： | 祁建国;梁挥 |
| 地址： | 100080 北*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明涉及一种超速时延测试系统和方法，系统包括时钟信号选择器和位于被测电路扫描链上的测试时钟生成模块。所述测试时钟生成模块，用于根据在扫描移入阶段扫描移入的控制位生成测试时钟，将所述测试时钟输入所述时钟信号选择器；所述测试时钟包含加载边缘和捕获边缘，所述加载边缘和所述捕获边缘的时延差代表超速测试时的时钟周期。所述时钟信号选择器，根据选择信号和全局扫描使能信号，从所述测试时钟、被测电路的工作时钟、和扫描时钟中选择，将选择的时钟输入被测电路时钟树上，用于支持完成所期望的时延测试。本发明通过在片内生成频率可编程的测试时钟，能够有效检测被测电路中的小时延缺陷。 | ||
| 搜索关键词： | 超速 测试 系统 方法 | ||
【主权项】：
一种超速时延测试系统，其特征在于，包括时钟信号选择器和位于被测电路扫描链上的测试时钟生成模块，所述测试时钟生成模块，用于根据在扫描移入阶段扫描移入的控制位生成测试时钟，将所述测试时钟输入所述时钟信号选择器，所述测试时钟包含加载边缘和捕获边缘，所述加载边缘和所述捕获边缘的时延差代表超速测试时的时钟周期；所述时钟信号选择器，用于从测试时钟、被测电路的工作时钟、和扫描时钟中选择，将选择的时钟输入被测电路时钟树上。
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