[发明专利]执行快速重复载入数据串操作的微处理器有效
| 申请号： | 201110023623.7 | 申请日： | 2011-01-21 |
| 公开（公告）号： | CN102156627A | 公开（公告）日： | 2011-08-17 |
| 发明（设计）人： | G.G.亨利;罗德尼.E.虎克 | 申请（专利权）人： | 威盛电子股份有限公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F9/32 |
| 代理公司： | 北京市柳沈律师事务所 11105 | 代理人： | 史新宏 |
| 地址： | 中国台*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种执行快速重复载入数据串操作的微处理器。该微处理器呼叫微码来回应遭遇一重复载入数据串指令。微码包括一系列的保证预取微指令，以将一系列的高速缓冲行撷取至微处理器的高速缓冲存储器，而这些高速缓冲行是由指令所指定的数据字节的数据串所隐含。在架构限制下，微处理器的存储器子系统保证被指定的高速缓冲行将被撷取至高速缓冲存储器。当存储器子系统判断出不存在会避免去撷取被指定的高速缓冲行的状况、而且在存储器子系统分配填充队列缓冲器以接收高速缓冲行时，存储器子系统将完成指令。引退单元释放分配给每一该保证预取微指令的重排序缓冲器的字段来回应指令的完成，不论该保证预取微指令所指定的高速缓冲行是否已被撷取至高速缓冲存储器。 | ||
| 搜索关键词： | 执行 快速 重复 载入 数据 操作 微处理器 | ||
【主权项】：
一种微处理器，用来处理一重复载入数据串指令，其中，该重复载入数据串指令指定在一存储器中一数据字节的数据串被载入至该微处理器的一架构寄存器，该微处理器包括：一存储器子系统，包括一高速缓冲存储器；以及一微码，其中，该微处理器呼叫该微码来回应遭遇该重复载入数据串指令，该微码包括一系列的多个保证预取微指令以将一系列的多个高速缓冲行撷取至该高速缓冲存储器，该多个高速缓冲行由该重复载入数据串指令所指定的该数据字节的该数据串所隐含；其中，在多个架构限制内，该存储器子系统保证每一该保证预取微指令所指定的该高速缓冲行将被撷取至该高速缓冲存储器。
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