[发明专利]串行数据接收器电路装置和串行数据接收方法无效
申请号: | 201110035433.7 | 申请日: | 2011-01-31 |
公开(公告)号: | CN102147785A | 公开(公告)日: | 2011-08-10 |
发明(设计)人: | 早坂和美;岩月龙二 | 申请(专利权)人: | 富士通株式会社 |
主分类号: | G06F13/40 | 分类号: | G06F13/40 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 王萍;李春晖 |
地址: | 日本神*** | 国省代码: | 日本;JP |
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摘要: | 本发明涉及一种串行数据接收器电路装置以及串行数据接收方法。该串行数据接收器电路装置用于接收以第一位长度定界的串行数据,该电路装置包括:串行/并行转换器电路,将串行数据转换为具有小于第一位长度的第二位长度的并行数据;数据保存电路,保存多个并行数据;检测器电路,检测接收到的串行数据中的定界符位置;检测位置保存电路,生成用于选择数据保存电路中存储的并行数据中包括的数据的选择信号;以及选择器电路,基于选择信号从数据定界符位置开始以第二位长度为单位选择数据。 | ||
搜索关键词: | 串行 数据 接收器 电路 装置 接收 方法 | ||
【主权项】:
一种串行数据接收器电路装置,其被配置为接收包括以第一位长度定界的通信数据的串行数据,以及以所述第一位长度定界的控制数据,所述电路装置包括:串行/并行转换器电路,接收串行数据,并且将所述串行数据转换为具有小于所述第一位长度的第二位长度的并行数据;数据保存电路,包括多个寄存器,所述寄存器的位宽度基本上等于所述第二位长度,所述数据保存电路按照输入数据的顺序保存由所述串行/并行转换器电路转换的多个并行数据;检测器电路,检测所述数据保存电路中存储的数据中包括的控制数据,并且检测接收到的串行数据中的定界符位置;检测位置保存电路,基于关于从所述检测器电路的检测结果获得的所述数据定界符位置的信息,生成用于选择所述数据保存电路中存储的并行数据中包括的数据的选择信号,其中从所述数据定界符位置开始以所述第二位长度为单位选择数据;以及选择器电路,基于所述检测位置保存电路生成的所述选择信号,从所述数据保存电路中存储的数据中以所述第二位长度为单位选择数据,其中基于检测到的定界符位置来选择数据。
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