[发明专利]减小沟槽型功率晶体管沟槽内多晶硅顶端V型槽的方法有效
申请号: | 201110386845.5 | 申请日: | 2011-11-29 |
公开(公告)号: | CN103137482A | 公开(公告)日: | 2013-06-05 |
发明(设计)人: | 石亮;孙张虎;施晓东;瞿学峰 | 申请(专利权)人: | 和舰科技(苏州)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28 |
代理公司: | 北京连和连知识产权代理有限公司 11278 | 代理人: | 贺小明 |
地址: | 215123 江苏省苏*** | 国省代码: | 江苏;32 |
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摘要: | 本发明公开了一种减小沟槽型功率晶体管沟槽内多晶硅顶端V型槽的方法,其包括以下步骤:在功率晶体管上形成沟槽;在沟槽内沉积多晶硅以形成栅极,同时在多晶硅顶端形成V型槽;然后在栅极的上表面沉积用于填充V型槽的多晶硅;最后蚀刻沉积的多晶硅已形成凹陷深度较小的V型槽。本发明可以大大减小多晶硅顶端的V型槽凹陷深度,达到减小栅极上方Cont电阻以及防止Cont无法连接栅极而导致开关器件失效,它可以广泛应用于沟槽型功率晶体管沟槽内栅极的形成中。 | ||
搜索关键词: | 减小 沟槽 功率 晶体管 多晶 顶端 方法 | ||
【主权项】:
一种减小沟槽型功率晶体管沟槽内多晶硅顶端V型槽的方法,其特征在于,包括以下步骤:步骤1:提供一基底,所述基底上表面设置有外延层,所述外延层上表面设置有垫层氧化层,所述垫层氧化层上表面设置有硬罩幕层;步骤2:采用光刻在所述硬罩幕层上定义出沟槽区域;然后采用蚀刻在位于所述硬罩幕层的沟槽区域下方的所述垫层氧化层上继续定义沟槽;步骤3:在所述步骤2最终形成的沟槽基础上,进一步采用蚀刻在位于所述垫层氧化层的沟槽下方的所述外延层上形成用作栅极的沟槽;步骤4:在所述步骤3的形成用作栅极的沟槽基础上,去除所述硬罩幕层;步骤5:在所述步骤4的基础上,在所述外延层的上表面设置栅极氧化层;然后在所述栅极氧化层的上表面沉积用于填充沟槽的多晶硅;步骤6:蚀刻所述步骤5中用于填充沟槽的多晶硅以形成栅极,同时在沟槽内多晶硅顶端形成V型槽;步骤7:在所述步骤6的基础上形成的栅极的上表面沉积用于填充V型槽的多晶硅;步骤8:蚀刻所述步骤7中沉积的多晶硅以形成栅极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造