[实用新型]一种基于可配置QC-LDPC编译码算法的硬件仿真验证平台有效
| 申请号： | 201120482552.2 | 申请日： | 2011-11-28 |
| 公开（公告）号： | CN202475439U | 公开（公告）日： | 2012-10-03 |
| 发明（设计）人： | 李斌;许仕龙;白杏杏;李军佑;王天彪;杜克明;程理丽;杨婷 | 申请（专利权）人： | 中国电子科技集团公司第五十四研究所 |
| 主分类号： | H04L1/00 | 分类号： | H04L1/00;H04L12/26 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 050081 河北省石家庄市*** | 国省代码： | 河北;13 |
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| 摘要： | 本实用新型公开了一种基于可配置QC-LDPC编译码算法的硬件仿真验证平台，涉及通信信道编解码领域，验证了不同码长、码率的编解码性能，为通信信道纠错码提供了很好的解决方案。数据源产生信号，调制到一定频率上，再进行编码操作，编码之后的信号加噪，再译码出该信号，将此信号解调还原出原来信号，与数据源产生的信号来比较，检测出误码率。该硬件验证系统有着非常大的灵活性，码长、码率、迭代次数可配置可变，噪声种类可变，调制方式可变，因此该系统可用于仿真不同的通信场合，来验证QC-LDPC码的适应性，并通过仿真得出何种场合何种码字信息码的性能达到最优。 | ||
| 搜索关键词： | 一种 基于 配置 qc ldpc 译码 算法 硬件 仿真 验证 平台 | ||
【主权项】：
一种基于可配置QC‑LDPC编译码算法的硬件仿真验证平台，包括计算机监控模块(3)、控制模块(1)和编译码模块(2)；其特征在于：控制模块(1)还包括数据源模块(10)、数据调制模块(11)、第一缓冲存储模块(12)、加法器模块(13)、噪声产生模块(14)、第二缓冲存储模块(15)、数据解调模块(16)、误码检测器模块(17)；编译码模块(2)包括编码器(20)和译码器(21)；所述计算机监控模块(3)与控制模块(1)相连，数据源模块(10)输出端口与数据调制模块(11)输入端口相连，数据调制模块(11)输出端口与第一缓冲存储模块(12)输入端口相连，第一缓冲存储模块(12)输出端口与编码器(20)输入端口相连，编码器(20)输出端口与加法器模块(13)输入端口相连，噪声产生模块(14)输出端口与加法器模块(13)输入端口相连，加法器模块(13)输出端口与第二缓冲存储模块(15)输入端口相连，第二缓冲存储模块(15)输出端口与译码器(21)输入端口相连，译码器(21)输出端口与数据解调模块(16)输入端口相连，数据解调模块(16)输出端口、数据源模块(10)输出端口均与误码检测器模块(17)输入端口相连；计算机监控模块(3)输入包括码长、码率、迭代次数编译码控制参数，与数据源模块(10)相连产生编译码信号，通过数据调制模块(11)把该信号调制到合适信道，在进行编码前通过第一缓冲存储模块(12)进行缓存，编码后的信号与噪声产生模块(14)通过加法器模块(13)进行混合；编码后信号与噪声的混合信号暂存于第二缓冲存储模块(15)中，译码器(21)把数据从第二缓冲存储模块(15)中取出来，进行译码，然后把译码后信号送入数据解调模块(16)进行解调复原，复原后与数据源产生的信号同时送入误码检测器模块(17)进行误码判断，对编解码模块性能进行测试。
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