[发明专利]智能架构创建器无效
| 申请号： | 201180061038.4 | 申请日： | 2011-09-19 |
| 公开（公告）号： | CN103270512A | 公开（公告）日： | 2013-08-28 |
| 发明（设计）人： | 阿南德·潘德伦根;皮尔斯·吴;西瓦·塞法拉;桑杰·班奈杰;阿南斯·朵巴;瑟雷许·凯迪耶拉;萨蒂许·帕德马纳班 | 申请（专利权）人： | 艾尔葛托奇普股份有限公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50 |
| 代理公司： | 北京林达刘知识产权代理事务所(普通合伙) 11277 | 代理人： | 刘新宇 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 本发明公开了一种自动生成用于利用计算机可读代码描述的定制集成电路即定制IC的处理器架构的系统和方法。所述IC具有一个或多个时序制约和硬件制约。所述系统从所述计算机可读代码的静态配置文件和动态配置文件提取定义所述处理器架构的参数；通过改变一个或多个参数来迭代地优化所述处理器架构，直到满足了表示为成本函数的所有时序制约和硬件制约为止；以及将所生成的处理器架构综合为所述定制集成电路的计算机可读描述以用于半导体制造。 | ||
| 搜索关键词： | 智能 架构 创建 | ||
【主权项】：
一种自动生成用于利用计算机可读代码描述的定制集成电路即定制IC的处理器架构的方法，所述IC具有至少一个或多个时序制约和硬件制约，所述方法包括：a.从所述计算机可读代码的静态配置文件和动态配置文件提取定义所述处理器架构的参数；b.通过改变一个或多个参数来迭代地优化所述处理器架构，直到满足了表示为成本函数的所有时序制约和硬件制约为止；以及c.将所生成的处理器架构综合为所述定制集成电路的计算机可读描述以用于半导体制造。
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