[发明专利]一种高精度CCD视频信号采样时序微调方法有效
| 申请号： | 201210206373.5 | 申请日： | 2012-06-21 |
| 公开（公告）号： | CN102740011A | 公开（公告）日： | 2012-10-17 |
| 发明（设计）人： | 李丙玉;王晓东 | 申请（专利权）人： | 中国科学院长春光学精密机械与物理研究所 |
| 主分类号： | H04N5/372 | 分类号： | H04N5/372;H04N5/378 |
| 代理公司： | 长春菁华专利商标代理事务所 22210 | 代理人： | 张伟 |
| 地址： | 130033 吉*** | 国省代码： | 吉林;22 |
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| 摘要： | 一种高精度CCD视频信号采样时序微调方法属于CCD探测器成像设计技术领域，步骤如下：FPGA的输入时钟经IBUFG后接入DCM1，CLK0端输出时钟经BUFG驱动后得到全局时钟SysClk，DCM1锁定状态标志信号取反经两级D触发器锁存后，作为DCM2的复位信号；SysClk接入DCM2的CLKIN端，CLK0输出端经BUFG驱动后得到CdsClk，并接入DCM2的反馈时钟端CLKFB，通过TimingCon模块实现CdsClk与SysClk的相位关系动态调整控制。本发明实现了CCD视频信号采样时序的高精度微量调整，调整精度提高到数十皮秒量级，解决了传统设计方法无法采样最佳时序位置问题。 | ||
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【主权项】：
一种高精度CCD视频信号采样时序微调方法，其特征在于，该方法包括如下步骤：步骤一：成像控制器FPGA的输入时钟经输入全局缓冲IBUFG接入DCM1，DCM1的CLK0端输出时钟经全局缓冲BUFG驱动后得到全局时钟SysClk，该时钟用于产生探测器CCD的驱动时序，使得CCD视频信号与全局时钟SysClk具有固定的相位关系；步骤二：DCM1锁定状态标志信号取反经两级触发器锁存后，作为DCM2的复位信号，避免DCM1在进行相位锁定时DCM2工作异常；步骤三：SysClk接入DCM2的CLKIN端，DCM2的CLK0输出端经BUFG驱动后得到CdsClk，用于产生CCD视频信号的采样时序，并接入DCM2的反馈时钟端CLKFB；步骤四：通过TimingCon模块进行CdsClk与SysClk之间的相位关系动态调整控制，实现高精度CCD视频信号采样时序微调的方法。
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