[发明专利]用于MPEG-2视频解码的SDRAM存储结构有效
| 申请号： | 201210275758.7 | 申请日： | 2012-08-03 |
| 公开（公告）号： | CN102833541A | 公开（公告）日： | 2012-12-19 |
| 发明（设计）人： | 谭洪舟;徐永钊;陆许明;何列琦;张全琪;徐永键 | 申请（专利权）人： | 东莞中山大学研究院 |
| 主分类号： | H04N7/26 | 分类号： | H04N7/26 |
| 代理公司： | 广州凯东知识产权代理有限公司 44259 | 代理人： | 李俊康 |
| 地址： | 523808 广东省东莞*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种高数据吞吐率的用于MPEG-2视频解码的SDRAM存储结构，它包括：用于接收MPEG-2视频解码的各种请求信号，并将处理后的请求信号提交给状态机控制以及命令解码单元，同时平衡MPEG-2视频解码端与SDRAM控制端之间数据传输速度的访问接口单元；接收各种请求信号，根据当前状态按照一定的仲裁机制执行某个请求的操作，同时负责SDRAM控制系统状态机的运作，并将各个操作转换成控制SDRAM的相关命令信号的状态机控制以及命令解码单元；接收到MPEG-2解码端传来的逻辑地址后，将其转换成控制SDRAM的相关物理地址的地址映射单元；对各种命令信号、数据信号以及地址映射单元的各种地址信号进行延迟、筛选处理，产生可直接输出到SDRAM芯片的控制信号的SDRAM接口单元。 | ||
| 搜索关键词： | 用于 mpeg 视频 解码 sdram 存储 结构 | ||
【主权项】：
一种用于MPEG‑2视频解码的SDRAM存储结构，其特征在于，它包括：用于接收MPEG‑2视频解码的各种请求信号，并将处理后的请求信号提交给状态机控制以及命令解码单元，同时平衡MPEG‑2视频解码端与SDRAM控制端之间数据传输速度的访问接口单元；接收由访问接口单元处理过的各种请求信号，根据当前状态按照一定的仲裁机制执行某个请求的操作，同时负责SDRAM控制系统状态机的运作，并将各个操作转换成控制SDRAM的相关命令信号的状态机控制以及命令解码单元；接收到MPEG‑2解码端传来的逻辑地址后，将其按照一定的数据存储方式转换成控制SDRAM的相关物理地址的地址映射单元；对状态机控制以及命令解码单元的各种命令信号、数据信号以及地址映射单元的各种地址信号进行延迟、筛选处理，产生可直接输出到SDRAM芯片的控制信号的SDRAM接口单元，各单元之间相互通信，将MPEG‑2视频解码中的存取请求转换成用以控制SDRAM芯片的命令信号、地址信号和数据信号。
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