[发明专利]应用于信号处理芯片的高速信号采样和同步的架构及方法有效
| 申请号： | 201210363144.4 | 申请日： | 2012-09-26 |
| 公开（公告）号： | CN102931994A | 公开（公告）日： | 2013-02-13 |
| 发明（设计）人： | 吕继平;陈俊宇;文建澜;邸晓晓;吴新春 | 申请（专利权）人： | 成都嘉纳海威科技有限责任公司 |
| 主分类号： | H03M1/54 | 分类号： | H03M1/54 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 610016 四川省成都市*** | 国省代码： | 四川;51 |
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| 摘要： | 本发明公开了一种应用于信号处理芯片的高速信号采样和同步的架构，其特征在于：包括可调延时链模块、与可调延时链模块连接的异步FIFO模块、与异步FIFO模块连接的读控制信号产生单元、用于接收启动信号并开始计数的第一计数器和与第一计数器连接的内部自启动信号产生单元，内部自启动信号产生单元与异步FIFO模块连接。该架构完成了ADC时钟信号的可调延时处理，并通过异步FIFO模块进行异步写入，同步读取，实现单路信号采样的稳定性和多路信号之间的同步性，使高速信号的传输更稳定、更可靠。 | ||
| 搜索关键词： | 应用于 信号 处理 芯片 高速 采样 同步 架构 方法 | ||
【主权项】：
一种应用于信号处理芯片的高速信号采样和同步的架构，其特征在于：包括可调延时链模块、与可调延时链模块连接的异步FIFO模块、与异步FIFO模块连接的读控制信号产生单元、用于接收启动信号并开始计数的第一计数器和与第一计数器连接的内部自启动信号产生单元，内部自启动信号产生单元与异步FIFO模块连接。
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