[发明专利]一种FinFET器件的制造方法有效
申请号: | 201210514156.2 | 申请日: | 2012-12-04 |
公开(公告)号: | CN103855021B | 公开(公告)日: | 2017-04-05 |
发明(设计)人: | 邓浩 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L29/78 |
代理公司: | 北京市磐华律师事务所11336 | 代理人: | 董巍,高伟 |
地址: | 201203*** | 国省代码: | 上海;31 |
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摘要: | 本发明提供一种FinFET器件的制造方法,包括提供自上而下依次包括硅基体、第一掩埋氧化物层、第一多晶硅层、第二掩埋氧化物层以及硅衬底的基底;在硅基体上形成硬掩膜层;在图案化的硬掩膜层的侧壁上形成间隙壁;以硬掩膜层及间隙壁为掩膜,蚀刻硅基体,以形成凹槽;在硅基体的侧壁上形成背栅栅氧化层;在凹槽中形成背栅栅极,在其顶部形成氧化物层;去除硬掩膜层;去除未被间隙壁和氧化物层遮蔽的硅基体,以形成Fin;在Fin的侧壁上形成前栅栅氧化层;去除未被间隙壁和氧化物层遮蔽的第一掩埋氧化物层;在基底上形成第三多晶硅层,以完全覆盖背栅;图案化多晶硅层,以形成前栅栅极。根据本发明,可以形成具有高密度背栅的FinFET,有效地控制阈值电压Vt。 | ||
搜索关键词: | 一种 finfet 器件 制造 方法 | ||
【主权项】:
一种FinFET器件的制造方法,包括:提供自上而下依次包括第一硅基体、第一掩埋氧化物层、第一多晶硅层、第二掩埋氧化物层以及硅衬底的基底;在所述第一硅基体上形成硬掩膜层;图案化所述硬掩膜层,以形成用于蚀刻所述第一硅基体的掩膜;在露出的所述硬掩膜层的侧壁上形成间隙壁;以所述硬掩膜层以及所述间隙壁为掩膜,蚀刻所述第一硅基体,以形成凹槽;在露出的所述第一硅基体的侧壁上形成构成背栅结构的栅氧化层的第一氧化物层;在所述凹槽中形成所述背栅结构的栅极,并在所述栅极的顶部形成第二氧化物层;去除所述硬掩膜层;以所述间隙壁和所述第二氧化物层为掩膜,蚀刻去除未被所述间隙壁和所述第二氧化物层遮蔽的第一硅基体,以形成所述FinFET的Fin;在露出的所述Fin的侧壁上形成构成前栅结构的栅氧化层的第三氧化物层;以所述间隙壁和所述第二氧化物层为掩膜,蚀刻去除未被所述间隙壁和所述第二氧化物层遮蔽的第一掩埋氧化物层;在所述基底上形成第三多晶硅层,以完全覆盖所述背栅结构;图案化所述第三多晶硅层和所述第一多晶硅层,以形成所述前栅结构的栅极。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造