[实用新型]一种基于FPGA的高可靠Link接收电路有效
| 申请号： | 201220625265.7 | 申请日： | 2012-11-23 |
| 公开（公告）号： | CN202949450U | 公开（公告）日： | 2013-05-22 |
| 发明（设计）人： | 王可;曾永红;陈茜 | 申请（专利权）人： | 中国航天科工集团第三研究院第八三五七研究所 |
| 主分类号： | H04L25/02 | 分类号： | H04L25/02;H04L1/00 |
| 代理公司： | 核工业专利中心 11007 | 代理人： | 包海燕 |
| 地址： | 300308 天津*** | 国省代码： | 天津;12 |
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| 摘要： | 本实用新型属于基于现场可编程门阵列(FPGA)设计技术领域，具体涉及一种基于FPGA的高可靠Link接收电路。本实用新型的接收电路包括Link接收电路和计时复位控制电路，计时复位控制电路通过对输入的Link时钟总线状态进行监控和计时，输出复位信号对Link接口进行复位。本实用新型解决了现有技术中基于FPGA的接收电路无法实现DSP与FPGA之间高可靠Link通信的技术问题；能够有效排除干扰信号对Link接收电路的影响，显著提高基于FPGA的Link接收电路的可靠性。 | ||
| 搜索关键词： | 一种 基于 fpga 可靠 link 接收 电路 | ||
【主权项】：
一种基于FPGA的高可靠Link接收电路，包括Link接收电路，其特征在于：还包括计时复位控制电路，计时复位控制电路通过对输入的Link时钟总线状态进行监控和计时，输出复位信号对Link接口进行复位。
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