[发明专利]一种降低失调电压影响的带隙基准电压电路无效
| 申请号： | 201310110341.X | 申请日： | 2013-03-29 |
| 公开（公告）号： | CN103197716A | 公开（公告）日： | 2013-07-10 |
| 发明（设计）人： | 祝靖;孙国栋;宋慧滨;孙伟锋;陆生礼;时龙兴 | 申请（专利权）人： | 东南大学 |
| 主分类号： | G05F1/567 | 分类号： | G05F1/567 |
| 代理公司： | 南京天翼专利代理有限责任公司 32112 | 代理人： | 汤志武 |
| 地址： | 214135 江*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种降低失调电压影响的带隙基准电压电路，基于传统的带隙基准电压电路结构，设有PNP三极管Q1、Q2和Q3、运算放大器OP、电阻R1和R2、PMOS管M1、M2和M3，其特征在于：在PNP三极管Q1及Q2的发射极与基极之间分别增设电阻R3及R5，在PNP三极管Q1及Q2的基极与地之间分别增设电阻R4及R6。本发明通过引入分压电阻网络，从结构上减小失调电压VOS的系数，从而降低了失调电压对基准电压的影响，可以得到精度更高、稳定性更好的基准电压。 | ||
| 搜索关键词： | 一种 降低 失调 电压 影响 基准 电路 | ||
【主权项】：
一种降低失调电压影响的带隙基准电压电路，基于传统的带隙基准电压电路结构，设有PNP三极管Q1、Q2和Q3、运算放大器OP、电阻R1和R2、PMOS管M1、M2和M3；PNP三极管Q1、Q2和Q3的基极和集电极均接地，PNP三极管Q1的发射极通过电阻R1连接放大器OP的同相输入端和PMOS管M1的漏极，PNP三极管Q2的发射极连接放大器OP的反相输入端和PMOS管M2的漏极，运算放大器OP的输出端与PMOS管M1、M2、M3的栅极连接，PMOS管M1、M2、M3的源极和衬底均连接电源VDD，PNP三极管Q3的发射极通过电阻R2连接PMOS管M3的漏极并作为输出端输出基准电压Vref；其特征在于：在PNP三极管Q1及Q2的发射极与基极之间分别增设电阻R3及R5，在PNP三极管Q1及Q2的基极与地之间分别增设电阻R4及R6。
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