[发明专利]与FPGA结合的FLASH芯片及指令处理方法有效
| 申请号： | 201310495546.4 | 申请日： | 2013-10-21 |
| 公开（公告）号： | CN104572015B | 公开（公告）日： | 2018-08-03 |
| 发明（设计）人： | 张新楼;潘荣华;张赛 | 申请（专利权）人： | 北京兆易创新科技股份有限公司 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F21/44 |
| 代理公司： | 北京润泽恒知识产权代理有限公司 11319 | 代理人： | 赵娟 |
| 地址： | 100083 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供了一种与FPGA结合的FLASH芯片，所述FPGA与Flash‑1之间通过互连的内部IO引脚对进行内部相互通信；所述FPGA与Flash‑2中相同的IO引脚相连，并且连接到所述芯片的同一外部共享引脚上；外部指令通过所述芯片的外部共享引脚传输到Flash‑2与FPGA中，Flash‑2与FPGA分别判断是否执行所述外部指令；若所述外部指令为所述Flash‑2无法识别的RPMC验证指令，则FPGA依据配置信息与RPMC的值生成第一RPMC验证值，并判断是否与RPMC验证指令中的第二RPMC验证值一致；若不一致，则所述芯片为非法芯片。本发明用以解决设计复杂度高，设计周期长，设计成本高，通用性弱，工作效率低等问题。 | ||
| 搜索关键词： | 外部指令 验证指令 芯片 引脚 验证 设计复杂度 非法芯片 工作效率 配置信息 设计周期 指令处理 不一致 共享 外部 互连 传输 通信 | ||
【主权项】：
1.一种与FPGA结合的FLASH芯片，其特征在于，包括：现场可编程门阵列FPGA，第一存储芯片Flash‑1，以及，第二存储芯片Flash‑2；所述FPGA中设置有应答保护单调计数器RPMC及配置信息；所述第一存储芯片Flash‑1中存储有所述RPMC的值，其中，所述Flash‑1和所述FPGA各自包括内部IO引脚，所述Flash‑1的内部IO引脚与所述FPGA的内部IO引脚互连，所述FPGA与所述Flash‑1之间通过互连的内部IO引脚对进行内部相互通信；所述FPGA与所述Flash‑2中相同的IO引脚相连，并且连接到所述FLASH芯片的同一外部共享引脚上；外部指令通过所述FLASH芯片的外部共享引脚传输到所述Flash‑2与所述FPGA中，所述Flash‑2与所述FPGA分别判断是否执行所述外部指令；其中，所述外部指令包括RPMC验证指令；若所述外部指令为所述Flash‑2无法识别的RPMC验证指令，则所述FPGA依据配置信息与所述RPMC的值生成第一RPMC验证值，并判断是否与所述RPMC验证指令中的第二RPMC验证值一致；若不一致，则所述FLASH芯片为非法芯片。
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