[发明专利]具有双端口从锁存器的正边缘预设触发器有效
申请号: | 201410054933.9 | 申请日: | 2014-02-18 |
公开(公告)号: | CN103997319B | 公开(公告)日: | 2018-07-03 |
发明(设计)人: | 史蒂文·巴特林;苏丹舒·康纳 | 申请(专利权)人: | 德州仪器公司 |
主分类号: | H03K3/3562 | 分类号: | H03K3/3562 |
代理公司: | 北京律盟知识产权代理有限责任公司 11287 | 代理人: | 路勇 |
地址: | 美国德*** | 国省代码: | 美国;US |
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摘要: | 本申请案涉及具有双端口从锁存器的正边缘预设触发器。在本发明的实施例中,一种触发器电路含有2输入多路复用器、主锁存器、传送门及从锁存器。所述多路复用器的扫描启用控制信号SE及SEN确定将数据还是扫描数据输入到所述主锁存器。时钟信号CKT及CLKZ以及保持控制信号RET及RETN确定何时锁存所述主锁存器。所述从锁存器经配置以接收所述主锁存器的输出、第二数据位D2、所述时钟信号CKT及CLKZ、所述保持控制信号RET及RETN、从控制信号SS及SSN。所述信号CKT、CLKZ、RET、RETN、SS、SSN及PREN确定在所述从锁存器中锁存所述主锁存器的所述输出还是所述第二数据位D2。控制信号RET及RETN确定在保持模式期间何时将数据存储于所述从锁存器中。 | ||
搜索关键词: | 从锁存器 控制信号 主锁存器 时钟信号 触发器 双端口 锁存 预设 输入多路复用器 触发器电路 多路复用器 扫描数据 数据存储 输出 申请案 扫描 传送 配置 | ||
【主权项】:
1.一种触发器电路,其包括:多路复用器,其经配置以接收第一数据位(D1)、扫描数据位(SD)、扫描启用控制信号(SE)及所述扫描启用控制信号(SE)的二进制逻辑补数信号(SEN),其中所述扫描启用控制信号(SE)及所述二进制逻辑补数信号(SEN)确定所述多路复用器的数据输出(MXO)是所述第一数据位(D1)的二进制补数还是扫描数据位(SD)的二进制补数;主锁存器,其经配置以接收所述多路复用器的所述数据输出(MXO)、时钟信号(CKT)、所述时钟信号(CKT)的二进制逻辑补数信号(CLKZ)、保持控制信号(RET)、所述保持控制信号(RET)的二进制逻辑补数信号(RETN)及预设信号(PREN),其中所述时钟信号(CKT)、所述二进制逻辑补数信号(CLKZ)、所述保持控制信号(RET)、所述二进制逻辑补数信号(RETN)及所述预设信号(PREN)确定何时在所述主锁存器的输出(MLO)上呈现所述数据输出(MXO)的二进制逻辑值及何时在所述主锁存器中锁存所述主锁存器的所述输出(MLO);传送门,其中所述传送门在所述时钟信号(CKT)从低逻辑值转变到逻辑高值时将数据从所述主锁存器的所述输出(MLO)传送到所述传送门的输出;其中所述传送门在信号PREN从逻辑“1”转变到逻辑“0”时将数据从所述主锁存器的所述输出(MLO)传送到所述传送门的所述输出;从锁存器,其经配置以接收所述传送门的所述输出(QN)、第二数据位(D2)、所述时钟信号(CKT)、所述时钟信号(CKT)的所述二进制逻辑补数信号(CLKZ)、所述保持控制信号(RET)、所述保持控制信号(RET)的所述二进制逻辑补数信号(RETN)、从控制信号(SS)及所述从控制信号(SS)的二进制逻辑补数信号(SSN),其中所述时钟信号(CKT)、所述二进制逻辑补数信号(CLKZ)、所述保持控制信号(RET)、所述二进制逻辑补数信号(RETN)、所述从控制信号(SS)及所述二进制逻辑补数信号(SSN)确定在所述从锁存器中锁存所述传送门的所述输出(QN)还是所述第二数据位(D2)。
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