[发明专利]50%占空比时钟产生电路有效
| 申请号： | 201410066721.2 | 申请日： | 2014-02-26 |
| 公开（公告）号： | CN104113303B | 公开（公告）日： | 2017-02-15 |
| 发明（设计）人： | 甘萍;朱樟明;刘马良;杨银堂;张鹏 | 申请（专利权）人： | 西安电子科技大学 |
| 主分类号： | H03K3/017 | 分类号： | H03K3/017 |
| 代理公司： | 北京银龙知识产权代理有限公司11243 | 代理人： | 许静,安利霞 |
| 地址： | 710071*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明提供一种50%占空比时钟产生电路，涉及数模混合集成电路设计领域。该电路包括低噪声放大缓冲电路及占空比调制电路，所述低噪声放大缓冲电路，用于对外部输入的差分时钟信号进行放大处理，生成单端时钟信号，并输出给所述占空比调制电路；所述占空比调制电路，用于对所述单端时钟信号的占空比进行调制，产生占空比为50%的时钟信号。该电路通过低噪声放大缓冲电路将差分时钟信号转换成单端时钟信号，并对所述单端时钟信号的占空比进行调制，产生占空比为50%的时钟信号，减小了模数转换电路中采样保持电路的设计难度和功耗，提高了模数转换量化器的信噪比（SNR）和无杂波动态范围（SFDR）。 | ||
| 搜索关键词： | 50 时钟 产生 电路 | ||
【主权项】：
一种50％占空比时钟产生电路，其特征在于，包括：低噪声放大缓冲电路及占空比调制电路，所述低噪声放大缓冲电路，用于对外部输入的差分时钟信号进行放大处理，生成单端时钟信号，并输出给所述占空比调制电路；所述占空比调制电路，用于对所述单端时钟信号的占空比进行调制，产生占空比为50％的时钟信号；其中，所述低噪声放大缓冲电路包括：由第一晶体管(M1)、第二晶体管(M2)、第三晶体管(M3)、第四晶体管(M4)和第五晶体管(M5)组成的单端输出的运算放大电路，用于对从第二晶体管(M2)和第三晶体管(M3)的栅极分别输入的低压差分时钟信号(ENC+和ENC‑)进行放大处理，并从第五晶体管(M5)的漏极输出第一输出时钟信号(CLK)；与所述第一输出时钟信号(CLK)连接的一反相电路，所述反相电路由第七晶体管(M7)和第八晶体管(M8)组成，用于将已放大的时钟信号的相位反转180度，得到单端时钟信号(CLKIN)，并输出给所述占空比调制电路；与所述单端输出的运算放大器连接的偏置电路，所述偏置电路由第六晶体管(M6)和第一电流源(I1)组成，用于给第一晶体管(M1)的栅极提供偏置电压；设置于所述单端输出的运算放大电路内部、所述偏置电路内部的低通滤波电路，用于抑制高频噪声的传输。
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