[发明专利]半导体结构及其形成方法有效

专利信息
申请号: 201410076994.5 申请日: 2014-03-04
公开(公告)号: CN104900631B 公开(公告)日: 2018-03-06
发明(设计)人: 杨广立;王刚宁;俞谦荣;冯喆韻;刘丽;唐凌;戴执中;孙泓 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
主分类号: H01L23/58 分类号: H01L23/58
代理公司: 北京集佳知识产权代理有限公司11227 代理人: 骆苏华
地址: 201203 *** 国省代码: 上海;31
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摘要: 一种半导体结构及其形成方法,其中半导体结构的形成方法包括提供衬底;在衬底内形成埋层区,埋层区具有导电性能;刻蚀去除部分厚度的衬底,在衬底内形成环形的第一沟槽、第二沟槽以及第三沟槽,第一沟槽和第三沟槽分别位于第二沟槽的两侧,第二沟槽底部为至少暴露出埋层区顶部;形成填充满第一沟槽和第三沟槽的阻挡层;形成填充满第二沟槽的导电层,导电层与埋层区相连接,且导电层的掺杂类型与埋层区的掺杂类型相同;在导电层和埋层区包围的衬底内形成掺杂阱。本发明在提高半导体结构抗噪声能力的同时,阻挡导电层内掺杂离子的扩散,避免掺杂离子过于靠近掺杂阱,从而提高半导体结构的电学性能和可靠性。
搜索关键词: 半导体 结构 及其 形成 方法
【主权项】:
一种半导体结构的形成方法,其特征在于,包括:提供衬底;在所述衬底内形成埋层区,所述埋层区具有导电性能,且所述埋层区内具有掺杂离子;刻蚀去除部分厚度的衬底,在所述衬底内形成环形的第一沟槽、第二沟槽以及第三沟槽,所述第一沟槽和第三沟槽分别位于第二沟槽的两侧,且第二沟槽底部至少暴露出埋层区顶部;形成填充满所述第一沟槽和第三沟槽的阻挡层;形成填充满所述第二沟槽的导电层,所述导电层与埋层区相连接,且所述导电层的掺杂类型与埋层区的掺杂类型相同;在所述导电层和埋层区包围的衬底内形成掺杂阱;在所述掺杂阱表面形成栅极结构;在所述栅极结构两侧的掺杂阱内形成掺杂区,对掺杂区进行退火处理。
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