[发明专利]一种NAND闪存及制备方法有效
申请号: | 201410550486.6 | 申请日: | 2014-10-16 |
公开(公告)号: | CN104269409A | 公开(公告)日: | 2015-01-07 |
发明(设计)人: | 亢勇;陈邦明 | 申请(专利权)人: | 上海新储集成电路有限公司 |
主分类号: | H01L27/115 | 分类号: | H01L27/115;H01L21/8247 |
代理公司: | 上海申新律师事务所 31272 | 代理人: | 吴俊 |
地址: | 201500 上海市*** | 国省代码: | 上海;31 |
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摘要: | 本发明提供了一种基于Gate Last金属栅工艺的二维NAND型闪存,采用金属栅工艺实现NAND单元的控制栅,而不是传统的多晶硅环绕控制栅,可以实现与高介电常数金属栅先进CMOS工艺的集成,与目前主流的Gate Last CMOS工艺兼容,克服了目前NAND闪存工艺无法与先进标准逻辑工艺兼容的问题。同时提出了如何在高介电常数金属栅先进CMOS工艺中实现高压DMOS器件的方法,以实现NAND闪存的擦写操作。 | ||
搜索关键词: | 一种 nand 闪存 制备 方法 | ||
【主权项】:
一种NAND闪存制备方法,其特征在于,包括如下步骤:提供一设置有隔离区和有源区的衬底,所述衬底中定义有CMOS电路区和存储单元阵列区;在所述衬底的上表面依次沉积一介电层和第一栅极材料层,刻蚀所述第一栅极材料层形成浮栅,且位于所述储存单元区之上的浮栅位于相邻所述隔离区之间的衬底之上;制备第一绝缘材料层覆盖在所述浮栅的上表面,且该第一绝缘材料层覆盖在存储单元阵列区之上的浮栅之间的介电层上表面;制备一牺牲栅极覆盖在第一绝缘材料层的上表面,且位于存储单元阵列区中的牺牲栅极同时将底部两侧浮栅的中间区域进行覆盖;于所述CMOS电路区的衬底中形成源/漏极;沉积第二绝缘材料层并抛光至牺牲栅极的上表面,移除所述牺牲栅极;移除位于所述CMOS电路区中的第一绝缘材料层及浮栅;沉积第二栅极材料层并抛光至所述第二绝缘材料层的上表面形成控制栅;形成金属互联结构。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的