[发明专利]用于防止纹波的输入/输出端有效
| 申请号： | 201510638910.7 | 申请日： | 2015-09-29 |
| 公开（公告）号： | CN105470241B | 公开（公告）日： | 2018-07-10 |
| 发明（设计）人： | Y·A·阿特萨尔;T·考库格鲁 | 申请（专利权）人： | 亚德诺半导体集团 |
| 主分类号： | H01L23/58 | 分类号： | H01L23/58 |
| 代理公司： | 中国国际贸易促进委员会专利商标事务所 11038 | 代理人： | 刘倜 |
| 地址： | 百慕大群岛(*** | 国省代码： | 百慕大群岛;BM |
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| 摘要： | 本公开内容的各个方面涉及配置以减轻来自射频(RF)输入输出路径到第二输入输出(I/O)路径，例如数字输入/输出路径的串扰。例如，这种串扰可以是由于相邻键合线之间的耦合。终端电路可以包括低阻抗损耗路径，例如串联的RC并联电路。根据某些实施例，静电放电(ESD)保护电路可以与终端电路并联。 | ||
| 搜索关键词： | 终端电路 串扰 输入输出路径 输入/输出端 相邻键合线 静电放电 输出路径 数字输入 耦合 低阻抗 并联 射频 纹波 串联 电路 输出 配置 | ||
【主权项】：
1.一种电子器件，包括：管芯，包括：电连接到所述管芯的第一键合焊盘的射频(RF)输入/输出路径，电连接到所述管芯的第二键合焊盘的第二输入/输出路径，被配置来在第二输入/输出路径上提供静电放电保护的静电放电保护电路，以及终端电路，电连接到所述管芯的所述第二键合焊盘，并与所述静电放电保护电路并联连接使得所述第二输入/输出路径被阻尼，其中所述射频输入/输出路径被配置来处理射频信号，并且所述第二输入/输出路径被配置来处理第二信号，所述第二信号是非射频信号；第一键合线，电连接到所述管芯的所述第一键合焊盘；和第二键合线，电连接到所述管芯的所述第二键合焊盘；其中，所述终端电路包括低阻抗损耗路径，并被配置来减轻由于所述第一键合线和所述第二键合线之间的耦合导致的串扰的影响，所述低阻抗损耗路径包括串联RC电路，其中所述串联RC电路的电容器的电容和电阻器的电阻被选择为使得所述终端电路在所述射频信号的频率提供终止。
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