[实用新型]双时钟测试电路有效
| 申请号： | 201521020482.3 | 申请日： | 2015-12-09 |
| 公开（公告）号： | CN205193232U | 公开（公告）日： | 2016-04-27 |
| 发明（设计）人： | 庄楠键;孙轶群 | 申请（专利权）人： | 深圳市盛德金科技有限公司 |
| 主分类号： | G01R31/28 | 分类号： | G01R31/28 |
| 代理公司： | 北京律和信知识产权代理事务所(普通合伙) 11446 | 代理人： | 刘国伟;武玉琴 |
| 地址： | 518057 广东省深圳市南山*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型公开了一种双时钟测试电路，包括主时钟产生电路、激励产生及比较电路、第一主时钟分频电路、第二主时钟分频电路；所述主时钟产生电路分别与第一主时钟分频电路以及第二主时钟分频电路电路连接，所述第一主时钟分频电路与激励产生及比较电路电路连接。使用时，激励产生及比较电路与被测试装置中的工作电路电路连接，所述第二主时钟分频电路与被测试装置中的控制时钟分频电路电路连接。通过本实用新型能够实现测试激励的产生、判断和待测集成电路使用同源时钟，每次反馈间隔可控，无需较多无效测试用例作为过渡，测试效率和测试覆盖率高的技术效果。 | ||
| 搜索关键词： | 时钟 测试 电路 | ||
【主权项】：
一种双时钟测试电路，包括主时钟产生电路以及激励产生及比较电路，其特征在于，还包括第一主时钟分频电路、第二主时钟分频电路；所述主时钟产生电路分别与第一主时钟分频电路以及第二主时钟分频电路电路连接，所述第一主时钟分频电路与激励产生及比较电路电路连接；使用时，激励产生及比较电路与被测试装置中的工作电路电路连接，所述第二主时钟分频电路与被测试装置中的控制时钟分频电路电路连接。
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