[发明专利]用于时钟和数据恢复的电路布置和方法有效
| 申请号： | 201580043997.1 | 申请日： | 2015-07-30 |
| 公开（公告）号： | CN107078743B | 公开（公告）日： | 2020-06-16 |
| 发明（设计）人： | 蒂博尔·凯赖凯什 | 申请（专利权）人： | ams有限公司 |
| 主分类号： | H03L7/10 | 分类号： | H03L7/10;H04L7/033;H04L7/10 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 陈炜;李德山 |
| 地址： | 奥地利*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种用于时钟和数据恢复的电路布置包括控制单元(CTRL)、锁相环电路(PLL)和采样单元(SMPL)。控制单元(CTRL)被配置为从输入信号(SDIN)得到第一参考信号(PLSN)和第二参考信号(PLSD)。此外，控制单元(CTRL)被配置为从根据电路布置的操作模式选择的第一参考信号(PLSN)和第二参考信号(PLSD)之一得到公共参考信号(FREF0)。锁相环电路(PLL)被配置为基于公共参考信号(FREF0)生成振荡器信号(SOSC)。采样单元(SMPL)被配置为从输入信号(SDIN)提取恢复的数据信号(RXD)。 | ||
| 搜索关键词： | 用于 时钟 数据 恢复 电路 布置 方法 | ||
【主权项】：
一种用于时钟和数据恢复的电路布置，所述电路布置包括：‑控制单元(CTRL)，其被配置为：‑从输入信号(SDIN)得到第一参考信号(PLSN)和第二参考信号(PLSD)；以及‑从根据所述电路布置的操作模式选择的所述第一参考信号(PLSN)和所述第二参考信号(PLSD)之一得到公共参考信号(FREF0)；‑锁相环电路(PLL)，其被配置为基于所述公共参考信号(FREF0)生成振荡器信号(SOSC)；以及‑采样单元(SMPL)，其被配置为根据所述振荡器信号(SOSC)，从所述输入信号(SDIN)提取恢复的数据信号(RXD)。
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