[发明专利]半导体结构及其制造方法有效
申请号: | 201610365196.3 | 申请日: | 2016-05-27 |
公开(公告)号: | CN107437533B | 公开(公告)日: | 2020-08-07 |
发明(设计)人: | 周飞 | 申请(专利权)人: | 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司 |
主分类号: | H01L21/8234 | 分类号: | H01L21/8234;H01L27/088;H01L29/10;H01L29/78 |
代理公司: | 北京集佳知识产权代理有限公司 11227 | 代理人: | 高静;吴敏 |
地址: | 201203 *** | 国省代码: | 上海;31 |
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摘要: | 一种半导体结构及其制造方法,所述方法包括:提供基底,包括第一深度区域、第二深度区域和第三深度区域;在第二深度区域基底内形成缓冲掺杂离子区;去除第二深度区域和第三深度区域的部分基底,形成衬底和凸出于衬底上的鳍部;在衬底上形成厚度与第二深度区域深度相等的隔离结构,露出于隔离结构的鳍部为鳍部第一区域,未露出部分为鳍部第二区域;在鳍部第二区域内形成离子类型与缓冲掺杂离子区相同的防穿通掺杂离子区,且离子浓度大于缓冲掺杂离子区;形成横跨鳍部的栅极结构;在栅极结构两侧的鳍部第一区域内形成源漏掺杂区。本发明通过使防穿通掺杂离子区的离子浓度介于源漏掺杂区和缓冲掺杂离子区之间,降低源漏掺杂区与衬底之间的结漏电流。 | ||
搜索关键词: | 半导体 结构 及其 制造 方法 | ||
【主权项】:
一种半导体结构的制造方法,其特征在于,包括:提供基底,所述基底自下至上依次包括第一深度区域、第二深度区域和第三深度区域;对所述第二深度区域基底进行缓冲离子掺杂工艺,形成缓冲掺杂离子区;去除所述第二深度区域和第三深度区域的部分基底,露出所述第一深度区域的基底,形成衬底以及凸出于所述衬底上的鳍部;在所述鳍部之间的衬底上形成隔离结构,所述隔离结构的厚度与所述第二深度区域的深度相等,露出于所述隔离结构的鳍部作为鳍部第一区域,未露出的鳍部作为鳍部第二区域;对所述鳍部第二区域进行防穿通离子掺杂工艺,形成位于所述缓冲掺杂离子区上的防穿通掺杂离子区,其中,所述防穿通掺杂离子区的离子类型与所述缓冲掺杂离子区的离子类型相同,且所述防穿通掺杂离子区的离子浓度大于所述缓冲掺杂离子区的离子浓度;形成横跨所述鳍部表面的栅极结构,所述栅极结构覆盖所述鳍部第一区域的部分顶部和侧壁;在所述栅极结构两侧的鳍部第一区域内形成源漏掺杂区,所述源漏掺杂区的离子类型与所述防穿通掺杂离子区的离子类型相反,且所述源漏掺杂区的离子浓度大于所述防穿通掺杂离子区的离子浓度。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造