[发明专利]并串转换电路有效
| 申请号： | 201610366319.5 | 申请日： | 2016-05-27 |
| 公开（公告）号： | CN107437945B | 公开（公告）日： | 2021-02-26 |
| 发明（设计）人： | 孟时光;赵鹏飞;杨宗仁 | 申请（专利权）人： | 龙芯中科技术股份有限公司 |
| 主分类号： | H03M9/00 | 分类号： | H03M9/00 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 张洋;刘芳 |
| 地址： | 100095 北京市海淀*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种并串转换电路，包括：反相器和N个动态触发器；N与接收到的并行数据的位数相同；N个动态触发器的输出端均与反相器的输入端连接；第n个动态触发器的数据接收端接收N位并行数据中的第n位数据，第n个动态触发器的时钟信号接收端接收第n个时钟信号；其中，各时钟信号的时钟周期均与N位并行数据的更新周期相同，且各时钟信号的高电平不交叠，各动态触发器的电路结构中不包括反相器，n的取值为从1至N的正整数。本发明提供的并串转换电路，简化了并串转换电路的结构，降低了路径上的时序要求并减少了电路所占面积。 | ||
| 搜索关键词： | 转换 电路 | ||
【主权项】：
一种并串转换电路，其特征在于，包括：反相器和N个动态触发器；所述N与接收到的并行数据的位数相同；所述N个动态触发器的输出端均与所述反相器的输入端连接；第n个所述动态触发器的数据接收端接收N位并行数据中的第n位数据，第n个动态触发器的时钟信号接收端接收第n个时钟信号；其中，各所述时钟信号的时钟周期均与所述N位并行数据的更新周期相同，且各所述时钟信号的高电平不交叠，各所述动态触发器的电路结构中不包括反相器，n的取值为从1至N的正整数。
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