[发明专利]时间数字系统以及频率合成器有效

专利信息
申请号: 201610836945.6 申请日: 2016-09-21
公开(公告)号: CN107026647B 公开(公告)日: 2020-10-30
发明(设计)人: 庄昀蓁;林昂生 申请(专利权)人: 联发科技股份有限公司
主分类号: H03L7/093 分类号: H03L7/093;G04F10/00;H03L7/091;H03L7/099
代理公司: 北京市万慧达律师事务所 11111 代理人: 白华胜;王蕊
地址: 中国台湾新竹市*** 国省代码: 台湾;71
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摘要: 发明提供一种时间数字系统和频率合成器。该时间数字系统用于接收参考时钟信号和可变时钟,可变时钟的频率高于参考时钟信号的频率,该时间数字系统包括:补充电路,用于生成延迟参考时钟信号,以及生成在延迟参考时钟信号的转变之前的响应于可变时钟的至少一个脉冲,延迟参考时钟信号是根据参考时钟信号和响应于可变时钟的转变而确定的延迟控制信号生成;以及耦接至补充电路的时间数字转换器(TDC),接收延迟参考时钟信号和所述响应于可变时钟的至少一个脉冲,并生成TDC信号。本发明的时间数字系统以及频率合成器,能够使得TDC的动态范围变得更加灵活,提高TDC的线性和转换速度,减少TDC噪音和功耗并使得TDC架构更简单。
搜索关键词: 时间 数字 系统 以及 频率 合成器
【主权项】:
一种时间数字系统,用于接收参考时钟信号和可变时钟,其中所述可变时钟的频率高于所述参考时钟信号的频率,所述时间数字系统包括:补充电路,用于生成延迟参考时钟信号,以及生成在所述延迟参考时钟信号的转变之前的响应于所述可变时钟的至少一个脉冲,其中所述延迟参考时钟信号根据所述参考时钟信号和响应于所述可变时钟的转变而确定的延迟控制信号生成;以及时间数字转换器TDC,耦接至所述补充电路,接收所述延迟参考时钟信号和所述响应于所述可变时钟的至少一个脉冲,并相应的生成TDC信号。
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