[发明专利]形成图案化结构的方法有效
申请号: | 201610885439.6 | 申请日: | 2016-10-11 |
公开(公告)号: | CN107919279B | 公开(公告)日: | 2019-11-26 |
发明(设计)人: | 陈界得;张峰溢;李甫哲;詹益旺 | 申请(专利权)人: | 联华电子股份有限公司;福建省晋华集成电路有限公司 |
主分类号: | H01L21/3213 | 分类号: | H01L21/3213 |
代理公司: | 11105 北京市柳沈律师事务所 | 代理人: | 陈小雯<国际申请>=<国际公布>=<进入 |
地址: | 中国台*** | 国省代码: | 中国台湾;TW |
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摘要: | 本发明公开一种形成图案化结构的方法,包括下列步骤。首先,在材料层上形成一硬掩模层之后,再进行第一蚀刻制作工艺与第二蚀刻制作工艺,用以分别于硬掩模层中形成彼此部分重叠的第一开口与第二开口。利用具有第一开口与第二开口的硬掩模层,对材料层进行第三蚀刻制作工艺,并于第三蚀刻制作工艺之后对位于材料层之下的介电层以及硬掩模层进行一第四蚀刻制作工艺,掩模层的材料与介电层的材料相同,故第四蚀刻制作工艺可用以将硬掩模层移除并于介电层中形成一沟槽。 | ||
搜索关键词: | 形成 图案 结构 方法 | ||
【主权项】:
1.一种形成图案化结构的方法,包括:/n在一基底上依序形成一介电层与一材料层;/n在该材料层上形成一硬掩模层,其中该硬掩模层的材料与该介电层的材料相同;/n在该硬掩模层上形成一第一图案化掩模,并利用该第一图案化掩模进行一第一蚀刻制作工艺,以于该硬掩模层中形成至少一第一开口,其中该第一开口至少部分暴露出该材料层;/n在该第一蚀刻制作工艺之后,将该第一图案化掩模移除,并于该硬掩模层上形成一第二图案化掩模,且利用该第二图案化掩模进行一第二蚀刻制作工艺,以于该硬掩模层中形成至少一第二开口,其中该第二开口至少部分暴露出该材料层,且该第一开口与该第二开口部分重叠;/n以具有该第一开口与该第二开口的该硬掩模层为掩模,对该材料层进行一第三蚀刻制作工艺,用以移除该第一开口与该第二开口所暴露的该材料层;以及/n在该第三蚀刻制作工艺之后,对该介电层以及该硬掩模层进行一第四蚀刻制作工艺,用以将该硬掩模层移除并于该介电层中形成一沟槽,/n所述方法还包括于该材料层与该介电层之间形成一阻障层,其中于该第三蚀刻制作工艺之后以及该第四蚀刻制作工艺之前,该介电层被该阻障层所覆盖,其中所述阻障层的厚度小于所述材料层的厚度。/n
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造