[发明专利]中断控制器有效
| 申请号： | 201680026322.0 | 申请日： | 2016-04-07 |
| 公开（公告）号： | CN107636630B | 公开（公告）日： | 2021-03-16 |
| 发明（设计）人： | T·奥兹刚纳;R·A·谢勒;E·泰瑞;J·罗斯 | 申请（专利权）人： | 微软技术许可有限责任公司 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16;G06F13/24 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 段登新;胡利鸣 |
| 地址： | 美国华*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种中断控制器包括可以接收MMIO操作请求的结构从电路、多个输出中断线路、多个中断寄存器(其中每个中断寄存器对应于一输出中断线路)、与结构从电路和中断寄存器通信的MMIO路由电路、用于接收线路中断的多个输入中断线路以及与输入中断线路和中断寄存器通信的线路中断路由电路。中断寄存器存储针对中断的数据，该数据用作中断的源和/或需要针对该中断完成(一个或多个)什么任务的指示。 | ||
| 搜索关键词： | 中断 控制器 | ||
【主权项】：
一种中断控制器，包括：连接到计算系统的结构的结构从电路，所述结构从电路被配置为接收包括MMIO地址和MMIO写入数据的MMIO写入请求，所述MMIO写入数据包括要针对MMIO中断完成的任务的指示；多个输出中断线路；多个中断寄存器，每个中断寄存器对应于所述多个输出中断线路的至少一个输出中断线路；以及MMIO路由电路，所述MMIO路由电路被连接到所述结构从电路和所述多个中断寄存器，所述MMIO路由电路被配置为将所接收的MMIO写入数据路由到与由所接收的MMIO地址所标识的目标输出中断线路对应的目标中断寄存器，以使得所述目标中断寄存器存储针对所述MMIO中断要完成的任务的指示，在所述目标中断寄存器中存储针对所述MMIO中断要完成的任务的指示触发所述目标输出中断线路的断言。
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