[发明专利]功率分配网络(PDN)下降/过冲减轻在审
| 申请号： | 201680044838.8 | 申请日： | 2016-07-01 |
| 公开（公告）号： | CN109074118A | 公开（公告）日： | 2018-12-21 |
| 发明（设计）人： | D·R·帕尔;M·W·奥勒姆;I·基姆;P·I·彭泽斯 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | G06F1/08 | 分类号： | G06F1/08 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 王茂华 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 提供了针对功率分配网络(PDN)下降/过冲减轻的系统和方法。在某些实施例中，当处理器正在切换时钟频率和/或处理器正在从活动模式转换到空闲模式时，通过将处理器的时钟信号的频率斜降来减轻过冲。在某些实施例中，当处理器正在切换时钟频率和/或处理器正在从空闲模式转换到活动模式时，通过将处理器的时钟信号的频率斜升来减轻下降(droop)。 | ||
| 搜索关键词： | 处理器 功率分配网络 活动模式 空闲模式 时钟频率 时钟信号 转换 斜升 | ||
【主权项】：
1.一种系统，包括：时钟电路，被配置为生成第一时钟信号；频率斜坡电路，被配置为：从所述时钟电路接收所述第一时钟信号，基于所述第一时钟信号提供第二时钟信号、并且调节所述第二时钟信号的频率；以及时钟控制器，被配置为指示所述频率斜坡电路斜降所述第二时钟信号的所述频率。
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