[发明专利]用于多线程式模式中的功率降低的方法和装置有效
| 申请号： | 201680088379.3 | 申请日： | 2016-09-21 |
| 公开（公告）号： | CN109564543B | 公开（公告）日： | 2020-09-15 |
| 发明（设计）人： | 安东尼·J·比贝尔 | 申请（专利权）人： | 超威半导体公司 |
| 主分类号： | G06F12/02 | 分类号： | G06F12/02;G06F9/30 |
| 代理公司： | 上海胜康律师事务所 31263 | 代理人： | 李献忠;张华 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 描述一种用于降低多线程内容可寻址存储器中的动态功率消耗的方法和装置。所述装置包括第一输入端，所述第一输入端被配置为接收对应于第一线程的第一虚拟地址；第二输入端，所述第二输入端被配置为接收对应于第二线程的第二虚拟地址；寄存器组，所述寄存器组包括多个寄存器，每个寄存器被配置为存储映射到多个物理地址中的一者的二进制字；第一比较器组，所述第一比较器组包括第一多个比较器，每个比较器以完全关联配置联接到所述多个寄存器中的相关联寄存器；第二比较器组，所述第二比较器组包括第二多个比较器，每个比较器以完全关联配置联接到所述多个寄存器中的相关联寄存器。输入到每个比较器组的虚拟地址在对应线程未被选择时维持其前一值。 | ||
| 搜索关键词： | 用于 多线程 模式 中的 功率 降低 方法 装置 | ||
【主权项】：
1.一种多线程内容可寻址存储器(CAM)设备，其包括：第一输入端，所述第一输入端被配置为接收对应于第一线程的第一虚拟地址；第二输入端，所述第二输入端被配置为接收对应于第二线程的第二虚拟地址；寄存器组，所述寄存器组包括多个寄存器，每个寄存器被配置为存储映射到多个物理地址中的一者的二进制字；第一比较器组，所述第一比较器组包括第一多个比较器，每个比较器以完全关联配置联接到所述多个寄存器中的一者，其中所述第一多个比较器中的每一个被配置为当所述第一线程启用且有效时接收所述第一虚拟地址并且当所述第一线程停用或无效时接收前一第一虚拟地址，其中所述前一第一虚拟地址是上次所述第一线程启用且有效时所述第一输入端所接收的所述第一虚拟地址；以及第二比较器组，所述第二比较器组包括第二多个比较器，每个比较器以所述完全关联配置联接到所述多个寄存器中的一者，其中所述第二多个比较器中的每一个被配置为当所述第二线程启用且有效时接收所述第二虚拟地址并且当所述第二线程停用或无效时接收前一第二虚拟地址，其中所述前一第二虚拟地址是上次所述第二线程启用且有效时所述第二输入端所接收的所述第二虚拟地址。
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