[发明专利]移位寄存器及逐次逼近型模数转换器在审

专利信息
申请号: 201710032804.3 申请日: 2017-01-16
公开(公告)号: CN108322219A 公开(公告)日: 2018-07-24
发明(设计)人: 刘飞;朱晓明;张楠;岳利华;曲世军 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
主分类号: H03M1/46 分类号: H03M1/46
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 张凤伟;吴敏
地址: 201203 *** 国省代码: 上海;31
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摘要: 一种移位寄存器及逐次逼近型模数转换器。所述移位寄存器包括:分别由多个可控开关组成的第一移位电路及第二移位电路,其中:所述第一移位电路,与数据输入端及时钟信号发生器耦接,适于在所述时钟信号发生器输出的时钟信号处于第一逻辑值期间,将所述数据输入端输入的数据输出至所述第一移位电路的输出端;所述第二移位电路,与所述第一移位电路的输出端耦接,适于在所述时钟信号发生器输出的时钟信号处于第二逻辑值期间,将所述第一移位电路的输出端存储的数据输出至所述移位寄存器的输出端。应用上述方案,可以简化SAR ADC中移位寄存器的结构。
搜索关键词: 移位电路 移位寄存器 输出端 时钟信号发生器 模数转换器 数据输入端 逐次逼近型 时钟信号 数据输出 耦接 信号发生器 可控开关 输出 存储 应用
【主权项】:
1.一种移位寄存器,其特征在于,包括:分别由多个可控开关组成的第一移位电路及第二移位电路,其中:所述第一移位电路,与数据输入端及时钟信号发生器耦接,适于在所述时钟信号发生器输出的时钟信号处于第一逻辑值期间,将所述数据输入端输入的数据输出至所述第一移位电路的输出端;所述第二移位电路,与所述第一移位电路的输出端耦接,适于在所述时钟信号发生器输出的时钟信号处于第二逻辑值期间,将所述第一移位电路的输出端存储的数据输出至所述移位寄存器的输出端。
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