[发明专利]一种基于查找表的FPGA芯片逻辑单元时延建模方法和系统有效
| 申请号： | 201710099785.6 | 申请日： | 2017-02-23 |
| 公开（公告）号： | CN108470078B | 公开（公告）日： | 2021-12-03 |
| 发明（设计）人： | 李佐渭;俞军;王似飞;叶翼;李小南 | 申请（专利权）人： | 上海复旦微电子集团股份有限公司 |
| 主分类号： | G06F30/327 | 分类号： | G06F30/327 |
| 代理公司： | 上海信好专利代理事务所(普通合伙) 31249 | 代理人： | 周乃鑫 |
| 地址： | 200433 上海市杨*** | 国省代码： | 上海;31 |
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| 摘要： | 本发明公开一种基于查找表的FPGA芯片逻辑单元时延建模方法，该方法包含：建立复杂逻辑单元的配置模型；建立复杂逻辑单元的时序路径模型；建立复杂逻辑单元的时序模型。本发明直接建立复杂逻辑单元的时序模型，不用将复杂逻辑单元拆分成简单逻辑单元，然后再STA过程中将简单逻辑的时序累加得到复杂逻辑的时序的过程，节省了拆分和计算过程，提高STA的运行效率。 | ||
| 搜索关键词： | 一种 基于 查找 fpga 芯片 逻辑 单元 建模 方法 系统 | ||
【主权项】：
1.一种基于查找表的FPGA芯片逻辑单元时延建模方法，其特征在于，该方法包含：建立复杂逻辑单元的配置模型；建立复杂逻辑单元的时序路径模型；建立复杂逻辑单元的时序模型。
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