[发明专利]可重构逻辑电路在审
| 申请号： | 201710321227.X | 申请日： | 2017-05-09 |
| 公开（公告）号： | CN107786198A | 公开（公告）日： | 2018-03-09 |
| 发明（设计）人： | 久木宫领;五十岚正智;石渡雅广;内山顺一;佐佐木日史;玉谷光之;山田和雄 | 申请（专利权）人： | 富士施乐株式会社 |
| 主分类号： | H03K19/177 | 分类号： | H03K19/177 |
| 代理公司： | 北京三友知识产权代理有限公司11127 | 代理人： | 吕俊刚,杨薇 |
| 地址： | 日本*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种可重构逻辑电路，包括数据处理单元；存储器，在所述存储器中存储有配置控制位的多个组合；以及选择器单元，所述选择器单元选择性地切换存储在所述存储器中的配置控制位的所述多个组合，并且将配置控制位的所述多个组合中的所选择的一个组合提供至所述数据处理单元，以重构所述数据处理单元的处理内容。 | ||
| 搜索关键词： | 可重构 逻辑电路 | ||
【主权项】：
一种可重构逻辑电路，所述可重构逻辑电路包括：数据处理单元；存储器，在所述存储器中存储有配置控制位的多个组合；以及选择器单元，所述选择器单元选择性地切换存储在所述存储器中的配置控制位的所述多个组合，并且将配置控制位的所述多个组合中的所选择的一个组合提供至所述数据处理单元，以重构所述数据处理单元的处理内容。
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