[发明专利]使用采样时间至数字转换器的倍频延迟锁定环路有效
| 申请号： | 201710477077.1 | 申请日： | 2017-06-21 |
| 公开（公告）号： | CN107528583B | 公开（公告）日： | 2022-04-19 |
| 发明（设计）人： | 王海松;O·布尔格 | 申请（专利权）人： | 马维尔亚洲私人有限公司 |
| 主分类号： | H03L7/081 | 分类号： | H03L7/081 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 酆迅 |
| 地址： | 新加坡*** | 国省代码： | 暂无信息 |
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| 摘要： | 倍频延迟锁定环路电路包括延迟链和反馈环路，延迟链包括串联连接的多个可变延迟电路并且具有延迟链输出，反馈环路包括用于获得数字控制信号的电路系统，该数字控制信号表示延迟链输出中的相位偏移的幅度和符号，以用于控制可变延迟电路中的可变延迟电路中的延迟。用于获得数字控制信号的电路系统包括被配置为对输入之间的时间延迟进行操作以生成数字控制信号的采样时间至数字转换器(STDC)。STDC用从延迟链输出和反馈除法器的输出获得的信号之间的第一差，减去从延迟链输出和反馈除法器的输出获得的信号之间的第二差，以提供差值，并且该差值指示延迟链输出中的输出偏移的符号和幅度。 | ||
| 搜索关键词： | 使用 采样 时间 数字 转换器 倍频 延迟 锁定 环路 | ||
【主权项】：
一种倍频延迟锁定环路电路，包括：延迟链，包括串联连接的多个可变延迟电路，并且具有延迟链输出；以及反馈环路，包括用于从所述延迟链供应的反馈信号来获得数字控制信号的电路系统，所述数字控制信号表示所述延迟链输出中的相位偏移的幅度和符号，以用于控制所述多个可变延迟电路中的可变延迟电路中的延迟。
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