[发明专利]存储电路和数据处理系统有效
| 申请号： | 201710747743.9 | 申请日： | 2017-08-25 |
| 公开（公告）号： | CN107785041B | 公开（公告）日： | 2023-06-16 |
| 发明（设计）人： | 希德哈塔·达斯;戴维·米歇尔·布尔;普若内·普拉巴特 | 申请（专利权）人： | ARM有限公司 |
| 主分类号： | G11C5/14 | 分类号： | G11C5/14;G11C7/10;G11C11/417 |
| 代理公司： | 中科专利商标代理有限责任公司 11021 | 代理人： | 倪斌 |
| 地址： | 英国*** | 国省代码： | 暂无信息 |
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| 摘要： | 一种存储电路包括：数据存储元件阵列；访问电路，用于通过针对数据存储元件的访问信号来访问由该数据存储元件存储的数据位，所述数据存储元件被使能以供访问；以及控制电路，用于使能各数据存储元件组以供访问，所述组具有组大小，所述组大小为1或更大，针对一组中的数据存储元件的访问信号被组合以提供对于该数据存储元件组公共的组合访问信号；所述控制电路配置为选择性地在至少第一模式和第二模式中操作，所述第一模式中的组大小不同于所述第二模式中的组大小。 | ||
| 搜索关键词： | 存储 电路 数据处理系统 | ||
【主权项】：
一种存储电路，包括：数据存储元件阵列；访问电路，用于通过针对数据存储元件的访问信号来访问由该数据存储元件存储的数据位，所述数据存储元件被使能以供访问；以及控制电路，用于使能各数据存储元件组以供访问，所述组具有组大小，所述组大小为1或更大，针对一组中的数据存储元件的访问信号被组合以提供对于该数据存储元件组公共的组合访问信号；所述控制电路配置为选择性地在至少第一模式和第二模式中操作，所述第一模式中的组大小不同于所述第二模式中的组大小。
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