[发明专利]一种数据压缩方法、系统及其CPU处理器在审
| 申请号： | 201710780050.X | 申请日： | 2017-09-01 |
| 公开（公告）号： | CN107508602A | 公开（公告）日： | 2017-12-22 |
| 发明（设计）人： | 李龙 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | H03M7/30 | 分类号： | H03M7/30;G06F9/48 |
| 代理公司： | 北京集佳知识产权代理有限公司11227 | 代理人： | 罗满 |
| 地址： | 450018 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本申请公开了一种数据压缩方法、系统及其CPU处理器，上述数据压缩方法包括CPU处理器对数据压缩算法所需的任务进行划分，得到串行执行任务和并行执行任务；CPU处理器将并行执行任务装载至硬件逻辑电路，并将并行执行任务所需的待压缩数据发送至硬件逻辑电路；硬件逻辑电路利用并行执行任务对待压缩数据执行相应的并行任务，得到相应的并行任务处理结果，并将并行任务处理结果发送至CPU处理器；CPU处理器利用串行执行任务对并行任务处理结果执行相应的串行任务，得到相应的串行任务处理结果。可见，本发明利用硬件逻辑电路执行数据压缩算法中所需的并行执行任务，而至于串行执行任务则通过CPU处理器来完成，实现了提升数据的压缩速率的目的。 | ||
| 搜索关键词： | 一种 数据压缩 方法 系统 及其 cpu 处理器 | ||
【主权项】：
一种数据压缩方法，其特征在于，包括：CPU处理器对数据压缩算法所需的任务进行划分，得到串行执行任务和并行执行任务；所述CPU处理器将所述并行执行任务装载至硬件逻辑电路，并将所述并行执行任务所需的待压缩数据发送至所述硬件逻辑电路；所述硬件逻辑电路利用所述并行执行任务对所述待压缩数据执行相应的并行任务，得到相应的并行任务处理结果，并将所述并行任务处理结果发送至所述CPU处理器；所述CPU处理器利用所述串行执行任务对所述并行任务处理结果执行相应的串行任务，得到相应的串行任务处理结果。
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