[发明专利]测试访存有效带宽的装置及方法有效
| 申请号： | 201710978643.7 | 申请日： | 2017-10-19 |
| 公开（公告）号： | CN107861846B | 公开（公告）日： | 2020-09-25 |
| 发明（设计）人： | 纪奎;刘立;窦晓光;王晖 | 申请（专利权）人： | 曙光信息产业（北京）有限公司 |
| 主分类号： | G06F11/22 | 分类号： | G06F11/22;G06F11/263 |
| 代理公司： | 北京兰亭信通知识产权代理有限公司 11667 | 代理人： | 赵永刚 |
| 地址： | 100193 北京*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供一种测试访存有效带宽的装置及方法。所述装置包括PCIe控制器、内存写引擎模块、内存读引擎模块和内存控制器，PCIe控制器通过PCIe接口与主机连接；主机用于向所述装置下发控制指令和读取计数指令，启动和停止进而计算出访存有效带宽；PCIe控制器用于解析与主机的PCIe接口时序，提取主机发送过来的PCIe事务层报文，解析出其中的读写请求并译码发送到对应的模块；内存写引擎模块用于根据访问方式和访问空间发起内存写请求，组织与内存控制器接口信号数据格式和时序要求；内存读引擎模块用于根据访问方式和访问空间发起内存读请求，组织与内存控制器接口信号时序要求和等待内存控制器返回的数据信号；内存控制器用于为用户侧提供至少四套读写访问接口。 | ||
| 搜索关键词： | 测试 有效 带宽 装置 方法 | ||
【主权项】：
一种测试访存有效带宽的装置，其特征在于，包括PCIe控制器、内存写引擎模块、内存读引擎模块和内存控制器，所述PCIe控制器通过PCIe接口与主机连接；其中，所述主机，用于通过PCIe接口向所述装置下发控制指令和读取计数指令，启动和停止进而计算出访存有效带宽；所述PCIe控制器，用于解析所述装置与主机的PCIe接口时序，提取所述主机发送过来的PCIe事务层报文，解析出其中的读写请求，并译码发送到对应的模块；所述内存写引擎模块，用于根据访问方式和访问空间，发起内存写请求，组织与所述内存控制器接口信号数据格式和时序要求；所述内存读引擎模块，用于根据访问方式和访问空间，发起内存读请求，组织与所述内存控制器接口信号时序要求和等待所述内存控制器返回的数据信号；所述内存控制器，用于为用户侧提供与内存之间的至少四套读写访问接口，根据内存芯片的相关参数发起内存芯片侧的相关操作。
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