[发明专利]一种有源应答器时钟生成电路、方法、系统及程序产品在审
| 申请号： | 201710983629.6 | 申请日： | 2017-10-20 |
| 公开（公告）号： | CN107994900A | 公开（公告）日： | 2018-05-04 |
| 发明（设计）人： | 郑桂燕;杨光伦;丁欢;张轲;陈光 | 申请（专利权）人： | 北京全路通信信号研究设计院集团有限公司 |
| 主分类号： | H03L7/18 | 分类号： | H03L7/18 |
| 代理公司： | 北京知联天下知识产权代理事务所(普通合伙)11594 | 代理人： | 王冲 |
| 地址： | 100070 北京市丰台区丰*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明提供了一种有源应答器的时钟生成电路、集成电路、方法及系统，包括多谐振荡器，以脉冲信号为触发，产生第一方波信号；锁相环，接收所述多谐振荡器产生的第一方波信号，对所述第一方波信号倍频，生成第二方波信号；有源逻辑处理模块CPLD，接收所述锁相环生成的所述第二方波信号，对所述第二方波信号进行分频生成第三方波信号，并将所述第三方波信号发送给所述锁相环；所述第三方波信号与所述第一方波信号在所述锁相环中形成锁相，生成时钟信号。本发明通过提取DBPL信号的边沿，经简单处理，即恢复DBPL同步时钟，电路简单，可靠性高，并兼顾了时钟稳定度和与DBPL原始信号的同步特性两方面性能。 | ||
| 搜索关键词： | 一种 有源 应答器 时钟 生成 电路 方法 系统 程序 产品 | ||
【主权项】：
一种有源应答器的时钟生成电路，所述电路包括多谐振荡器、锁相环、有源逻辑处理模块CPLD，其特征在于，所述多谐振荡器，以脉冲信号为触发，产生第一方波信号；所述锁相环，接收所述多谐振荡器产生的第一方波信号，对所述第一方波信号倍频，生成第二方波信号；所述有源逻辑处理模块CPLD，接收所述锁相环生成的所述第二方波信号，对所述第二方波信号进行分频生成第三方波信号，并将所述第三方波信号发送给所述锁相环；所述第三方波信号与所述第一方波信号在所述锁相环中形成锁相，生成时钟信号。
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