[实用新型]一种FPGA重配置结构有效
| 申请号： | 201720786347.2 | 申请日： | 2017-07-02 |
| 公开（公告）号： | CN207037658U | 公开（公告）日： | 2018-02-23 |
| 发明（设计）人： | 王利华;陈文俊;汤勇 | 申请（专利权）人： | 中国航空工业集团公司雷华电子技术研究所 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50;G06F15/78 |
| 代理公司： | 北京航信高科知识产权代理事务所(普通合伙)11526 | 代理人： | 高原 |
| 地址： | 214063 *** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型提供一种FPGA重配置结构，包括一个FPGA(1)、一个CPLD(2)以及多个SPIFLASH(3)，多个SPIFLASH(3)之间为并联相连关系，FPGA(1)与SPIFLASH(3)各对应接口之间通过CPLD(3)使用VHDL硬件开发语言逻辑直连，其中SPIFLASH(3)CK管脚与FPGA(1)CCLK管脚逻辑连通，SPIFLASH(3)CS/管脚与FPGA(1)FCS_B管脚逻辑连通，SPIFLASH(3)D管脚与FPGA(1)MOSI管脚逻辑连通，SPIFLASH(3)Q管脚与FPGA(1)DIN管脚逻辑连通。FPGA(1)根据需求通过在CPLD(2)上设置配置芯片片选总线来确定与FPGA(1)相接通的某一SPIFLASH(3)，通过CPLD(2)为FPGA(1)发送复位信号启动FPGA重配置结构。本实用新型解决传统的单片大容量Flash加载多套逻辑的方式存在的电路设计复杂、用户逻辑控制繁琐的缺点。 | ||
| 搜索关键词： | 一种 fpga 配置 结构 | ||
【主权项】：
一种FPGA重配置结构，其特征在于，包括一个FPGA(1)、一个CPLD(2)以及多个FLASH，该多个FLASH均通过同一CPLD(2)与FPGA(1)连接，其中该多个FLASH之间并联相连，FPGA(1)根据需求选择多个FLASH中的某一个FLASH接通。
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