[发明专利]混合存储器模块有效
| 申请号： | 201780041854.6 | 申请日： | 2017-10-10 |
| 公开（公告）号： | CN109416656B | 公开（公告）日： | 2023-08-11 |
| 发明（设计）人： | F·A·韦尔;J·E·林斯塔特;K·L·赖特 | 申请（专利权）人： | 拉姆伯斯公司 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10;G06F12/02;G11C7/10;G11C11/4093 |
| 代理公司： | 北京市金杜律师事务所 11256 | 代理人： | 酆迅;姚杰 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 存储器模块包括相对快速且持久的动态随机存取存储器(DRAM)的高速缓存，用于服务于更大量的相对慢和磨损敏感的非易失性存储器。本地控制器管理DRAM高速缓存和非易失性存储器之间的通信，以适应不同的存取粒度，减少必要数目的存储器事务，并最小化非易失性存储器组件外部的数据流。 | ||
| 搜索关键词： | 混合 存储器 模块 | ||
【主权项】：
1.一种存储器模块，包括：一排动态随机存取存储器(DRAM)组件，所述DRAM组件中的每一个DRAM组件具有DRAM数据宽度，所述一排DRAM组件具有所述DRAM数据宽度的和的排宽度；非易失性存储器组件，具有小于所述排宽度的非易失性数据宽度，所述非易失性存储器组件存储非易失性高速缓存行；以及模块控制器，被耦合到所述DRAM组件和所述非易失性存储器组件，所述模块控制器将来自所述非易失性存储器组件的所述非易失性高速缓存行跨所述DRAM组件分布，每个DRAM组件高速缓存每个分布的非易失性高速缓存行的子集。
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