[发明专利]为阵列和外围信号提供信号缓冲方案的存储器及操作方法有效
| 申请号： | 201810035348.2 | 申请日： | 2018-01-15 |
| 公开（公告）号： | CN108305649B | 公开（公告）日： | 2023-07-11 |
| 发明（设计）人： | 玛尼诗·钱德拉·乔希;帕文德·库马尔·拉纳;阿卡什·库马尔·古普塔 | 申请（专利权）人： | 三星电子株式会社 |
| 主分类号： | G11C8/12 | 分类号： | G11C8/12;G11C8/08;G11C7/22 |
| 代理公司： | 北京铭硕知识产权代理有限公司 11286 | 代理人： | 刘灿强;韩明花 |
| 地址： | 韩国京畿*** | 国省代码： | 暂无信息 |
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| 摘要： | 提供了一种为阵列和外围信号提供信号缓冲方案的存储器及操作方法。存储器包括多列存储器单元、控制电路和控制逻辑单元。多列存储器单元可以经由局部控制线连接到局部阵列信号生成器，局部控制线经由用于接收阵列信号的全局控制线来连接到全局阵列信号生成器。控制电路可以连接到用于提供外围信号的存储器单元。控制逻辑单元可以通过分级结构的全局控制线和局部控制线来连接到存储器单元。控制逻辑单元可以被配置为向全局控制线和局部控制线提供具有相同极性的阵列信号和外围信号。 | ||
| 搜索关键词： | 阵列 外围 信号 提供 缓冲 方案 存储器 操作方法 | ||
【主权项】：
1.一种存储器，所述存储器包括：多列存储器单元，被配置为接收阵列信号；控制电路，连接到所述多列存储器单元中的每个存储器单元，以用于提供外围信号；以及控制逻辑单元，通过分级结构的全局控制线和局部控制线来连接到控制电路和所述多列存储器单元中的每个存储器单元，其中，控制逻辑单元适于向全局控制线和局部控制线提供具有相同极性的阵列信号，并且向全局控制线和局部控制线提供具有相同极性的外围信号。
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