[发明专利]电路结构优化装置和机器学习装置在审
| 申请号： | 201810331928.6 | 申请日： | 2018-04-13 |
| 公开（公告）号： | CN108732964A | 公开（公告）日： | 2018-11-02 |
| 发明（设计）人： | 和泉均;栗原健一郎 | 申请（专利权）人： | 发那科株式会社 |
| 主分类号： | G05B19/042 | 分类号： | G05B19/042 |
| 代理公司： | 北京银龙知识产权代理有限公司 11243 | 代理人： | 曾贤伟;范胜杰 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种电路结构优化装置和机器学习装置，能够根据FPGA器件的当前位置或当前时刻降低产生误动作的频率。所述电路结构优化装置具有：状态数据取得部，其取得FPGA器件的当前位置和当前时刻中的至少某一个作为状态数据；电路结构决定部，其根据所述状态数据取得部取得的状态数据，决定所述FPGA器件上的电路结构，输出用于在FPGA器件上再构成决定出的电路结构的指令值。 | ||
| 搜索关键词： | 电路结构 状态数据 优化装置 机器学习装置 误动作 指令 输出 | ||
【主权项】：
1.一种电路结构优化装置，其进行FPGA器件的电路结构与配置的优化，其特征在于，所述电路结构优化装置具有：状态数据取得部，其取得所述FPGA器件的当前位置和当前时刻中的至少某一个作为状态数据；以及电路结构决定部，其根据所述状态数据取得部取得的所述状态数据，决定所述FPGA器件上的电路结构，输出用于在所述FPGA器件上再构成决定出的所述电路结构的指令值。
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